MasterStackPointer:
flash_mirror:...08040020 addr sram:DAT_STACK_20000408 ;= ??
Reset: ;XREF[3,0]: Entry Point,080000dc,0800010c
flash_mirror:...d5000008 addr ram.split:FUN_INT_RESET_080000d4+1
NMI: ;XREF[1,0]: Entry Point
flash_mirror:...09090008 addr ram.split:FUN_INT_NMI_RETURN_08000908+1
HardFault: ;XREF[1,0]: Entry Point
flash_mirror:...83080008 addr ram.split:FUN_INT_LOOP_FOREVER_080008...
MemManage: ;XREF[1,0]: Entry Point
flash_mirror:...00000000 addr 00000000
BusFault: ;XREF[1,0]: Entry Point
flash_mirror:...00000000 addr 00000000
UsageFault: ;XREF[1,0]: Entry Point
flash_mirror:...00000000 addr 00000000
Reserved1: ;XREF[1,1]: Entry Point,08000110
flash_mirror:...00000000 addr 00000000
Reserved2: ;XREF[1,0]: Entry Point
flash_mirror:...00000000 addr 00000000
Reserved3: ;XREF[1,0]: Entry Point
flash_mirror:...00000000 addr 00000000
Reserved5: ;XREF[1,0]: Entry Point
Reserved6:
Reserved4:
flash_mirror:...00000000 addr 00000000
SVCall: ;XREF[1,0]: Entry Point
flash_mirror:...990a0008 addr ram.split:FUN_INT_SVCALL_RETURN_08000...
flash_mirror:...00000000 addr 00000000
flash_mirror:...00000000 addr 00000000
PendSV: ;XREF[1,0]: Entry Point
flash_mirror:...99090008 addr ram.split:FUN_INT_PENDSV_RETURN_08000...
SysTick: ;XREF[1,0]: Entry Point
flash_mirror:...690b0008 addr ram.split:FUN_INT_SYSTICK_RETURN_0800...
IRQ: ;XREF[1,0]: Entry Point
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...2f070008 addr ram.split:FUN_EXTI_INT_0800072e+1
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...00000000 addr 00000000
flash_mirror:...00000000 addr 00000000
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...00000000 addr 00000000
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...00000000 addr 00000000
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
flash_mirror:...00000000 addr 00000000
flash_mirror:...27070008 addr ram.split:FUN_CAN_INT_08000726+1
flash_mirror:...05010008 addr ram.split:FUN_INT_IRQ_LOOP_FOREVER_08...
LAB_080000c0: ;XREF[1,1]: 080000f8,08000128
ram.split:080...0348 ldr r0=>sram:DAT_STA...,[->DAT_STACK_2000...;= 20000408
;= ??
ram.split:080...8546 mov sp,r0
ram.split:080...00f03cf8 bl FUN_START_08000140 ;undefined FUN_START_08000140()
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;void FUN_MAIN_WHILE_LOOP_08000c68(void)
;XREF[1,0]: 08000158
ram.split:080...0048 ldr r0,[PTR_FUN_MAIN_LOOP_08000c68+1_0800...;= 08000c69
ram.split:080...0047 bx r0=>FUN_MAIN_LOOP_08000c68 ;void FUN_MAIN_LOOP_08000c68(void)
PTR_FUN_MAIN_LOOP_08000c68+...;XREF[1,0]: 080000c8
ram.split:080...690c0008 addr FUN_MAIN_LOOP_08000c68+1
PTR_DAT_STACK_080000d0: ;XREF[1,0]: 080000c0
ram.split:080...08040020 addr sram:DAT_STACK_20000408 ;= ??
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;void FUN_INT_RESET_080000d4(void)
;XREF[0,1]: 00000004
ram.split:080...0c48 ldr r0,[FUN_INT_RESET_08000108]
ram.split:080...80f30888 msr msp,r0
ram.split:080...0c48 ldr r0,[->Reset] ;= 00000004
ram.split:080...0168 ldr r1,[r0,#0x0]=>flash_mirror:Reset ;= 080000d5
ram.split:080...090e lsrs r1,r1,#0x18
ram.split:080...0b4a ldr r2,[PTR_Reserved1+3_08000110] ;= 0000001f
ram.split:080...9142 cmp r1,r2
ram.split:080...05d1 bne LAB_080000f2
ram.split:080...0b48 ldr r0,[PTR_RCC.APB2ENR_08000114] ;= 40021018
ram.split:080...0b49 ldr r1,[DAT_00000001_08000118] ;= 1h
ram.split:080...0160 str r1,[r0,#0x0]=>RCC:RCC.APB2ENR
ram.split:080...0b48 ldr r0,[->Peripherals::SYSCFG] ;= 40010000
ram.split:080...0c49 ldr r1,[DAT_00000000_08000120]
ram.split:080...0160 str r1,[r0,#0x0]=>EXTI_SYSCFG_COMP:Periph...
LAB_080000f2: ;XREF[1,0]: 080000e4
ram.split:080...0c48 ldr r0,[PTR_FUN_RCC_CONFIG_08000b6c+1_080...;= 08000b6d
ram.split:080...8047 blx r0=>FUN_RCC_CONFIG_08000b6c ;undefined FUN_RCC_CONFIG_08000b6c()
ram.split:080...0c48 ldr r0,[PTR_LAB_080000c0+1_08000128] ;= 080000c1
ram.split:080...0047 bx r0=>LAB_080000c0
LAB_080000fa: ;XREF[1,0]: 080000fa
ram.split:080...fee7 b LAB_080000fa
LAB_080000fc: ;XREF[1,0]: 080000fc
ram.split:080...fee7 b LAB_080000fc
LAB_080000fe: ;XREF[1,0]: 080000fe
ram.split:080...fee7 b LAB_080000fe
LAB_08000100: ;XREF[1,0]: 08000100
ram.split:080...fee7 b LAB_08000100
LAB_08000102: ;XREF[1,0]: 08000102
ram.split:080...fee7 b LAB_08000102
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_INT_IRQ_LOOP_FOREVER_08000104()
;XREF[1,25]: 08000104,00000040,00000044,00000048
; 0000004c,00000050,00000058,0000005c
; 00000060,00000064,00000068,0000006c
; 00000070,00000074,00000078,0000007c
; 00000080,0000008c,00000094,00000098
; 0000009c,000000a4,000000a8,000000ac
; 000000b0,000000bc
ram.split:080...fee7 b FUN_INT_IRQ_LOOP_FOREVER_08000104
ram.split:080...0000 movs r0,r0
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_INT_RESET_08000108()
;caount undefined4 r1
;XREF[1,0]: 080000d4
ram.split:080...0804 lsls r0,r1,#0x10
ram.split:080...0020 movs r0,#0x0
PTR_Reset_0800010c: ;XREF[1,0]: 080000da
ram.split:080...04000000 uint * flash_mirror:Reset ;= 080000d5
PTR_Reserved1+3_08000110: ;XREF[1,0]: 080000e0
ram.split:080...1f000000 uint * flash_mirror:Reserved1+3
PTR_RCC.APB2ENR_08000114: ;XREF[1,0]: 080000e6
ram.split:080...18100240 struct_r...RCC:RCC.APB2ENR
DAT_00000001_08000118: ;XREF[1,0]: 080000e8
ram.split:080...01000000 uint 1h
PTR_SYSCFG_0800011c: ;XREF[1,0]: 080000ec
ram.split:080...00000140 uint * EXTI_SYSCFG_COMP:Peripherals::SYSCFG
DAT_00000000_08000120: ;XREF[1,0]: 080000ee
ram.split:080...00000000 uint 0h
PTR_FUN_RCC_CONFIG_08000b6c...;XREF[1,0]: 080000f2
ram.split:080...6d0b0008 uint * FUN_RCC_CONFIG_08000b6c+1
PTR_LAB_080000c0+1_08000128: ;XREF[1,0]: 080000f6
ram.split:080...c1000008 uint * LAB_080000c0+1
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_FILTER_MASK_HIGH_0800012c(struct_can_filter_config * can_filter)
;can_filter struct_can_... r0 ;XREF[1,0]: 08000130
;i undefined4 r1 ;XREF[1,0]: 0800012c
;value undefined4 r2
;maskid undefined4 r0 ;XREF[1,0]: 08000130
;XREF[2,0]: 08000308,0800031a
ram.split:080...0321 movs i,#0x3
ram.split:080...001d adds can_filter,can_filter,#0x4
LAB_08000130: ;XREF[1,0]: 0800013a
ram.split:080...401e subs maskid,maskid,#0x1
ram.split:080...0378 ldrb r3,[maskid,#0x0]
ram.split:080...1202 lsls value,value,#0x8
ram.split:080...1a43 orrs value,r3
ram.split:080...491e subs i,i,#0x1
ram.split:080...f9d5 bpl LAB_08000130
ram.split:080...1046 mov maskid,value
ram.split:080...7047 bx lr
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_START_08000140()
;mem_ptr uint * r4 ;XREF[1,0]: 08000140
;Is this some sort of initialisation for memory?
;Seems to be doing something with a couple of bytes at the end of the flash (values 2 & 3)???
;Trouble is there is no mem_ptr[3] defined...
;XREF[1,0]: 080000c4
ram.split:080...064c ldr mem_ptr,[LAB_0800015c]
ram.split:080...0125 movs r5,#0x1
ram.split:080...064e ldr r6,[LAB_08000160]
ram.split:080...05e0 b LAB_08000154
LAB_08000148: ;XREF[1,0]: 08000156
ram.split:080...e368 ldr r3,[mem_ptr,#0xc]=>PTR_SUB_08000cb0 ;= 08000c12
; FWD[5,0]: 08000ca4,08000ca8,08000cac,08000cc4
; 20000000
ram.split:080...07cc ldmia mem_ptr!,{ r0, r1, r2 }=>->UINT_00000...;= 2h
;= 20000000
;= 08000cc4
;= 8h
;= ??
ram.split:080...2b43 orrs r3,r5
ram.split:080...0c3c subs mem_ptr,#0xc
ram.split:080...9847 blx r3=>SUB_08000c12
ram.split:080...1034 adds mem_ptr,#0x10
LAB_08000154: ;XREF[1,0]: 08000146
ram.split:080...b442 cmp mem_ptr,r6
ram.split:080...f7d3 bcc LAB_08000148
ram.split:080...fff7b6ff bl FUN_MAIN_WHILE_LOOP_08000c68 ;void FUN_MAIN_WHILE_LOOP_08000c68(void)
LAB_0800015c: ;XREF[1,0]: 08000140
ram.split:080...a40c lsrs mem_ptr,mem_ptr,#0x12
ram.split:080...0008 lsrs r0,r0
LAB_08000160: ;XREF[1,0]: 08000144
ram.split:080...c40c lsrs mem_ptr,r0,#0x13
ram.split:080...0008 lsrs r0,r0
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_GPIO_INIT_PA4_LED_08000164()
;XREF[1,0]: 08000c82
ram.split:080...10b5 push { r4, lr }
ram.split:080...00f0bffb bl FUN_GPIO_INIT_PA4_LED_CONFIG_080008e8 ;undefined FUN_GPIO_INIT_PA4_LED_CONF...
ram.split:080...10bd pop { r4, pc }
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_GPIO_INIT_0800016c()
;can_filter struct_can_... -28 ;XREF[2,16]: 0800023e,08000262,08000234,08000236,08000238
; 08000242,08000246,08000248,0800024a,0800024e
; 08000258,0800025a,0800025c,08000266,0800026a
; 0800026c,0800026e,08000272
;nvic_config struct_nvic... -2c ;XREF[1,2]: 080001f0,080001f2,080001f4
;can_config struct_can_... -38 ;XREF[1,7]: 08000228,08000214,08000216,08000218,0800021a
; 0800021c,08000220,08000224
;gpio_config struct_gpio... -40 ;XREF[3,12]: 08000194,080001b4,080001cc,0800019a,0800019e
; 080001a2,080001a6,080001b8,080001ba,080001bc
; 080001be,080001d0,080001d2,080001d4,080001d6
;can_id_low... undefined2 HASH...
;XREF[1,0]: 08000c86
ram.split:080...f0b5 push { r4, r5, r6, r7, lr }
ram.split:080...0121 movs r1,#0x1
ram.split:080...8bb0 sub sp,#0x2c
ram.split:080...4804 lsls r0,r1,#0x11
;00020000 => 00000000 00000010 00000000 00000000
;
;Bit 17 IOPAEN: I/O port A clock enable
;Set and cleared by software.
;0: I/O port A clock disabled
;1: I/O port A clock enabled
ram.split:080...00f012fc bl FUN_RCC_AHBENR_0800099c ;undefined FUN_RCC_AHBENR_0800099c(un...
ram.split:080...0920 movs r0,#0x9
ram.split:080...0422 movs r2,#0x4
ram.split:080...0b21 movs r1,#00000000000000000000000000001011b
ram.split:080...c006 lsls r0=>GPIOC...,r0,#0x1b
;CAN Tx * Rx Alternate Functions
;https://www.st.com/resource/en/datasheet/stm32f042f6.pdf
;GPIOA AFR PA11 AF4 CAN Tx => 1011
;GPIOA AFR PA12 AF4 CAN Rx => 1100
ram.split:080...00f05efb bl FUN_GPIO_AFRL_08000840 ;undefined FUN_GPIO_AFRL_08000840(str...
ram.split:080...0920 movs r0,#0x9
ram.split:080...0422 movs r2,#0x4
ram.split:080...0c21 movs r1,#00000000000000000000000000001100b
ram.split:080...c006 lsls r0=>GPIOC...,r0,#0x1b
ram.split:080...00f058fb bl FUN_GPIO_AFRL_08000840 ;undefined FUN_GPIO_AFRL_08000840(str...
ram.split:080...0120 movs r0,#0x1
ram.split:080...c002 lsls r0,r0,#0xb
;PA11 AF CAN Rx (Pull-down)
ram.split:080...0090 str r0=>DAT_00000800,[sp,#0x0]=>gpio_conf...
ram.split:080...0227 movs r7,#0x2
ram.split:080...6846 mov r0,sp
ram.split:080...0771 strb r7,[r0,#gpio_config.gpio_moder+0x40]
ram.split:080...0326 movs r6,#0x3
ram.split:080...4671 strb r6,[r0,#gpio_config.gpio_opseedr+0x40]
ram.split:080...0024 movs r4,#0x0
ram.split:080...8471 strb r4,[r0,#gpio_config.gpio_otyper+0x40]
ram.split:080...0125 movs r5,#0x1
ram.split:080...c571 strb r5,[r0,#gpio_config.gpio_pupdr+0x40]
ram.split:080...0920 movs r0,#0x9
ram.split:080...6946 mov r1,sp
ram.split:080...c006 lsls r0=>GPIOC...,r0,#0x1b
ram.split:080...00f00ffb bl FUN_GPIO_CONFIG_080007d0 ;undefined FUN_GPIO_CONFIG_080007d0(s...
ram.split:080...2803 lsls r0,r5,#0xc
;PA12 AF CAN Tx (Pull-down)
ram.split:080...0090 str r0,[sp,#0x0]=>gpio_config.gpio_value
ram.split:080...6846 mov r0,sp
ram.split:080...0771 strb r7,[r0,#gpio_config.gpio_moder+0x40]
ram.split:080...4671 strb r6,[r0,#gpio_config.gpio_opseedr+0x40]
ram.split:080...8471 strb r4,[r0,#gpio_config.gpio_otyper+0x40]
ram.split:080...c571 strb r5,[r0,#gpio_config.gpio_pupdr+0x40]
ram.split:080...0920 movs r0,#0x9
ram.split:080...6946 mov r1,sp
ram.split:080...c006 lsls r0=>GPIOC...,r0,#0x1b
ram.split:080...00f003fb bl FUN_GPIO_CONFIG_080007d0 ;undefined FUN_GPIO_CONFIG_080007d0(s...
ram.split:080...4020 movs r0,#00000000000000000000000001000000b
;PA6 Output
;
;Looks like it is possibly connect from PA6 to TJA042 Pin 8 (STB 8 Standby mode control input). Makes sense as this will help reduce power.
;
;STB Normal mode:
;A LOW level on pin STB selects Normal mode. In this mode, the transceiver can transmit and receive data via the bus lines CANH and CANL.
;The differential receiver converts the analog data on the bus lines into digital data which is output to pin RXD. The slopes of the output signals on the bus lines are controlled internally and are optimized in a way that guarantees the lowest possible EME.
;
;Standby mode
;A HIGH level on pin STB selects Standby mode. In Standby mode, the transceiver is not able to transmit or correctly receive data via the bus lines. The transmitter and Normal-mode receiver blocks are switched off to reduce supply current, and only a low-power differential receiver monitors the bus lines for activity. The wake-up filter on the output of the low-power receiver does not latch bus dominant states, but ensures that only bus dominant and bus recessive states that persist longer than t fltr(wake)bus are reflected on pin RXD.
;In Standby mode, the bus lines are biased to ground to minimize the system supply current. The low-power receiver is supplied by VIO , and is capable of detecting CAN bus activity even if VIO is the only supply voltage available. When pin RXD goes LOW to signal a wake-up request, a transition to Normal mode will not be triggered until STB is forced LOW.
;
;Note: on the PCB, PA5 is also routed to a missing chip (U6 Pin 10).
;
ram.split:080...0090 str r0,[sp,#0x0]=>gpio_config.gpio_value
ram.split:080...6846 mov r0,sp
ram.split:080...0571 strb r5,[r0,#gpio_config.gpio_moder+0x40]
ram.split:080...4671 strb r6,[r0,#gpio_config.gpio_opseedr+0x40]
ram.split:080...8471 strb r4,[r0,#gpio_config.gpio_otyper+0x40]
ram.split:080...c471 strb r4,[r0,#gpio_config.gpio_pupdr+0x40]
ram.split:080...0920 movs r0,#0x9
ram.split:080...6946 mov r1,sp
ram.split:080...c006 lsls r0=>GPIOC...,r0,#0x1b
ram.split:080...00f0f7fa bl FUN_GPIO_CONFIG_080007d0 ;undefined FUN_GPIO_CONFIG_080007d0(s...
ram.split:080...0920 movs r0,#0x9
ram.split:080...4021 movs r1,#00000000000000000000000001000000b
ram.split:080...c006 lsls r0=>GPIOC...,r0,#0x1b
;Make PA6 Output Low
;
;STB Low: Normal Mode
ram.split:080...00f041fb bl FUN_GPIO_BRR_0800086e ;undefined FUN_GPIO_BRR_0800086e(stru...
ram.split:080...1e21 movs r1,#0x1e
ram.split:080...6846 mov r0,sp
ram.split:080...0175 strb r1,[r0,#nvic_config.nvic_bit_num+0x40]
ram.split:080...4575 strb r5,[r0,#nvic_config.nvic_ipro_data+0x40]
ram.split:080...8575 strb r5,[r0,#nvic_config.write+0x40]
ram.split:080...05a8 add r0,sp,#0x14
ram.split:080...00f088fb bl FUN_GPIO_NVIC_0800090c ;undefined FUN_GPIO_NVIC_0800090c(str...
ram.split:080...0121 movs r1,#0x1
ram.split:080...4806 lsls r0,r1,#0x19
ram.split:080...00f0d8fb bl FUN_RCC_APB1ENR_080009b4 ;undefined FUN_RCC_APB1ENR_080009b4(u...
ram.split:080...204f ldr r7,[->Peripherals::CAN] ;= 40006400
ram.split:080...3846 mov r0=>CAN:Peripherals::CAN,r7
ram.split:080...00f048f8 bl FUN_CAN_RCC_RESET_0800029c ;undefined FUN_CAN_RCC_RESET_0800029c()
ram.split:080...02a8 add r0,sp,#0x8
;Not sure why it sets default only to override with final values...?
ram.split:080...00f033fa bl FUN_CAN_DEFAULTS_08000678 ;undefined FUN_CAN_DEFAULTS_08000678(...
ram.split:080...6846 mov r0,sp
ram.split:080...8473 strb r4,[r0,#can_config.time_triggered_mod...
ram.split:080...c473 strb r4,[r0,#can_config.auto_bus_off+0x40]
ram.split:080...0494 str r4,[sp,#can_config.auto_wakeup+0x40]
ram.split:080...8472 strb r4,[r0,#can_config.mode+0x40]
ram.split:080...c472 strb r4,[r0,#can_config.sync_jump_width+0x40]
ram.split:080...0821 movs r1,#0x8
ram.split:080...0173 strb r1,[r0,#can_config.timeseg_1+0x40]
ram.split:080...0721 movs r1,#0x7
ram.split:080...4173 strb r1,[r0,#can_config.timeseg_2+0x40]
ram.split:080...1421 movs r1,#20
ram.split:080...0181 strh r1,[r0,#can_config.prescaler+0x40]
ram.split:080...02a9 add r1,sp,#0x8
ram.split:080...3846 mov r0=>CAN:Peripherals::CAN,r7
ram.split:080...00f0a7f8 bl FUN_CAN_CONFIG_08000380 ;undefined FUN_CAN_CONFIG_08000380(CA...
ram.split:080...08a8 add r0,sp,#0x20
;List Mode, Dual 16 Bit Scale
ram.split:080...8470 strb r4,[r0,#can_filter.filter_num+0x20]
ram.split:080...c570 strb r5,[r0,#can_filter.filter_mode+0x20]
ram.split:080...0471 strb r4,[r0,#can_filter.filter_scale+0x20]
ram.split:080...1449 ldr r1,[UINT_0000B820_0800028c] ;= B820h
ram.split:080...6846 mov r0,sp
;STDID[10:0], RTR, IDE and EXTID[17:15]
;
;0xB820 => 10111000 00100000
;
;ID => 10111000001 => 0x5c1
;
ram.split:080...0183 strh r1,[r0,#can_filter.filter_canid_high+...
ram.split:080...134e ldr r6,[UINT_00000FFF_08000290] ;= FFFh
;0x0FFF => 111111111111
;
;Can ID => 11111111111 => 0x7ff (used in all the low values
;
;This seems to be a waste - why is 0x7ff listed 4 times, when it is not used ???
;They could have just used one filter config, as it provides 4 CanIds in the one list (0x5c1, 0x575, 0x436 & 0x439 => which match those in CAN MAIN LOOP)
;
ram.split:080...4683 strh r6,[r0,#can_filter.filter_canid_low+0...
ram.split:080...1349 ldr r1,[UINT_0000AEA0_08000294] ;= AEA0h
;0xAEA0 => 10101110 10100000
;
;Top 11 bits:
;Can ID => 10101110101 => 0x575
;
ram.split:080...8183 strh r1,[r0,#can_filter.filter_maskid_high...
ram.split:080...c683 strh r6,[r0,#can_filter.filter_maskid_low+...
ram.split:080...0484 strh r4,[r0,#can_filter.filter_fifo+0x40]
ram.split:080...08a8 add r0,sp,#0x20
ram.split:080...4571 strb r5,[r0,#can_filter.filter_enabled+0x20]
ram.split:080...06a8 add r0,sp,#0x18
ram.split:080...00f02ff8 bl FUN_CAN_FILTER_080002b4 ;undefined FUN_CAN_FILTER_080002b4(st...
ram.split:080...08a8 add r0,sp,#0x20
ram.split:080...8570 strb r5,[r0,#can_filter.filter_num+0x20]
ram.split:080...c570 strb r5,[r0,#can_filter.filter_mode+0x20]
ram.split:080...0471 strb r4,[r0,#can_filter.filter_scale+0x20]
ram.split:080...0e49 ldr r1,[UINT_000086C0_08000298] ;= 86C0h
ram.split:080...6846 mov r0,sp
;0x86C0 => 10000110 11000000 => CanID 0x436
ram.split:080...0183 strh r1,[r0,#can_filter.filter_canid_high+...
ram.split:080...0c49 ldr r1,[UINT_000086C0_08000298] ;= 86C0h
ram.split:080...4683 strh r6,[r0,#can_filter.filter_canid_low+0...
;0x8720 => 10000111 00100000 => CanID 0x439
ram.split:080...6031 adds r1,#0x60
ram.split:080...8183 strh r1,[r0,#can_filter.filter_maskid_high...
ram.split:080...c683 strh r6,[r0,#can_filter.filter_maskid_low+...
ram.split:080...0484 strh r4,[r0,#can_filter.filter_fifo+0x40]
ram.split:080...08a8 add r0,sp,#0x20
ram.split:080...4571 strb r5,[r0,#can_filter.filter_enabled+0x20]
ram.split:080...06a8 add r0,sp,#0x18
ram.split:080...00f01df8 bl FUN_CAN_FILTER_080002b4 ;undefined FUN_CAN_FILTER_080002b4(st...
ram.split:080...0122 movs r2,#0x1
ram.split:080...0221 movs r1,#0x2
ram.split:080...3846 mov r0=>CAN:Peripherals::CAN,r7
;CAN_IER: Bit 1 FMPIE0: FIFO message pending interrupt enable
;0: No interrupt generated when state of FMP[1:0] bits are not 00b.
;1: Interrupt generated when state of FMP[1:0] bits are not 00b
ram.split:080...00f076f8 bl FUN_CAN_IER_SETBIT_08000370 ;undefined FUN_CAN_IER_SETBIT_0800037...
ram.split:080...0bb0 add sp,#0x2c
ram.split:080...f0bd pop { r4, r5, r6, r7, pc }
PTR_CAN_08000288: ;XREF[1,0]: 08000204
ram.split:080...00640040 CAN * CAN:Peripherals::CAN
UINT_0000B820_0800028c: ;XREF[1,0]: 0800023a
ram.split:080...20b80000 uint B820h
UINT_00000FFF_08000290: ;XREF[1,0]: 08000240
ram.split:080...ff0f0000 uint FFFh
UINT_0000AEA0_08000294: ;XREF[1,0]: 08000244
ram.split:080...a0ae0000 uint AEA0h
UINT_000086C0_08000298: ;XREF[2,0]: 0800025e,08000264
ram.split:080...c0860000 uint 86C0h
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_RCC_RESET_0800029c()
;XREF[1,0]: 08000208
ram.split:080...10b5 push { r4, lr }
ram.split:080...0121 movs r1,#0x1
ram.split:080...4c06 lsls r4,r1,#0x19
ram.split:080...2046 mov r0,r4
;02000000 => 00000010 00000000 00000000 00000000
;
;Bit 25 CANRST: CAN interface reset
;Set and cleared by software.
;0: No effect
;1: Reset CAN interface
ram.split:080...00f092fb bl FUN_CAN_RCC_APB1RSTR_SETBIT_080009cc ;undefined FUN_CAN_RCC_APB1RSTR_SETBI...
ram.split:080...0021 movs r1,#0x0
ram.split:080...2046 mov r0,r4
ram.split:080...00f08efb bl FUN_CAN_RCC_APB1RSTR_SETBIT_080009cc ;undefined FUN_CAN_RCC_APB1RSTR_SETBI...
ram.split:080...10bd pop { r4, pc }
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_FILTER_080002b4(struct_can_filter_config * can_filter)
;can_filter struct_can_... r0 ;XREF[1,0]: 08000308
;in_r2 uint r2
;filter_num... undefined4 r6 ;XREF[1,0]: 080002c0
;value undefined4 r1 ;XREF[1,0]: 080002c4
;val undefined4 r0 ;XREF[1,0]: 08000308
;can_filter... undefined4 HASH...
;uVar1 undefined1 HASH...
;uVar2 undefined1 HASH...
;uVar3 undefined1 HASH...
;uVar4 undefined1 HASH...
;uVar5 undefined1 HASH...
;uVar6 undefined1 HASH...
;uVar7 undefined1 HASH...
;uVar8 undefined1 HASH...
;XREF[2,0]: 08000252,08000276
ram.split:080...70b5 push { r4, r5, r6, lr }
ram.split:080...0546 mov r5,can_filter
ram.split:080...817a ldrb r1,[r0,#can_filter->filter_num]
ram.split:080...0120 movs can_filter,#0x1
ram.split:080...0646 mov r6,can_filter
ram.split:080...2b4c ldr r4,[PTR_CAN.CAN_FMR_0800036c] ;= 40006600
ram.split:080...8e40 lsls filter_num_bit,r1
ram.split:080...2168 ldr r1,[r4,#0x0]=>CAN:CAN.CAN_FMR
ram.split:080...0143 orrs value,can_filter
;CAN filter master register (CAN_FMR)
;
;Bit 0 FINIT: Filter initialization mode
;Initialization mode for filter banks
;0: Active filters mode.
;1: Initialization mode for the filters.
ram.split:080...2160 str value,[r4,#0x0]=>CAN:CAN.CAN_FMR
ram.split:080...e069 ldr can_filter,[r4,#offset CAN:CAN.CAN_FA...
ram.split:080...b043 bics can_filter,filter_num_bit
;Disable filter num
ram.split:080...e061 str can_filter,[r4,#offset CAN:CAN.CAN_FA...
ram.split:080...287b ldrb can_filter,[r5,#0xc]
;Dual 16 bit filters
ram.split:080...0028 cmp can_filter,#0x0
ram.split:080...12d1 bne LAB_080002fa
ram.split:080...e068 ldr can_filter,[r4,#offset CAN:CAN.CAN_FS...
ram.split:080...b043 bics can_filter,filter_num_bit
ram.split:080...e060 str can_filter,[r4,#offset CAN:CAN.CAN_FS...
ram.split:080...e888 ldrh can_filter,[r5,#0x6]
ram.split:080...6988 ldrh value,[r5,#0x2]
ram.split:080...0004 lsls can_filter,can_filter,#0x10
ram.split:080...0843 orrs can_filter,value
ram.split:080...a97a ldrb value,[r5,#0xa]
ram.split:080...c900 lsls value,value,#0x3
ram.split:080...0919 adds value,value,r4
;Check the order
;
ram.split:080...0864 str can_filter,[value,#offset CAN:CAN.F0R...
ram.split:080...a888 ldrh can_filter,[r5,#0x4]
ram.split:080...2988 ldrh value,[r5,#0x0]
ram.split:080...0004 lsls can_filter,can_filter,#0x10
ram.split:080...0843 orrs can_filter,value
ram.split:080...a97a ldrb value,[r5,#0xa]
ram.split:080...c900 lsls value,value,#0x3
ram.split:080...0919 adds value,value,r4
ram.split:080...4864 str can_filter,[value,#offset CAN:CAN.F0R...
LAB_080002fa: ;XREF[1,0]: 080002d2
ram.split:080...287b ldrb can_filter,[r5,#0xc]
;32 bit filters
ram.split:080...0128 cmp can_filter,#0x1
ram.split:080...14d1 bne LAB_0800032a
ram.split:080...e068 ldr can_filter,[r4,#offset CAN:CAN.CAN_FS...
ram.split:080...3043 orrs can_filter,filter_num_bit
ram.split:080...e060 str can_filter,[r4,#offset CAN:CAN.CAN_FS...
ram.split:080...2846 mov can_filter,r5
ram.split:080...fff710ff bl FUN_CAN_FILTER_MASK_HIGH_0800012c ;undefined FUN_CAN_FILTER_MASK_HIGH_0...
ram.split:080...1021 movs value,#16
ram.split:080...c841 rors val,value
ram.split:080...a97a ldrb value,[r5,#0xa]
ram.split:080...c900 lsls value,value,#0x3
ram.split:080...0919 adds value,value,r4
ram.split:080...0864 str val,[value,#offset CAN:CAN.F0R1 &0xff]
ram.split:080...281d adds val,r5,#0x4
ram.split:080...fff707ff bl FUN_CAN_FILTER_MASK_HIGH_0800012c ;undefined FUN_CAN_FILTER_MASK_HIGH_0...
ram.split:080...1021 movs value,#16
ram.split:080...c841 rors val,value
ram.split:080...a97a ldrb value,[r5,#0xa]
ram.split:080...c900 lsls value,value,#0x3
ram.split:080...0919 adds value,value,r4
ram.split:080...4864 str val,[value,#offset CAN:CAN.F0R2 &0xff]
LAB_0800032a: ;XREF[1,0]: 080002fe
ram.split:080...e87a ldrb val,[r5,#0xb]
ram.split:080...0028 cmp val,#0x0
ram.split:080...6068 ldr val,[r4,#offset CAN:CAN.CAN_FM1R &0xff]
ram.split:080...05d0 beq LAB_0800033e
ram.split:080...3043 orrs val,filter_num_bit
;Set filter mode
LAB_08000334: ;XREF[1,0]: 08000340
ram.split:080...6060 str val,[r4,#offset CAN:CAN.CAN_FM1R &0xff]
ram.split:080...2889 ldrh val,[r5,#0x8]
ram.split:080...0028 cmp val,#0x0
ram.split:080...02d0 beq LAB_08000342
ram.split:080...04e0 b LAB_08000348
LAB_0800033e: ;XREF[1,0]: 08000330
ram.split:080...b043 bics val,filter_num_bit
ram.split:080...f8e7 b LAB_08000334
LAB_08000342: ;XREF[1,0]: 0800033a
ram.split:080...6069 ldr val,[r4,#offset CAN:CAN.CAN_FFA1R &0xff]
ram.split:080...b043 bics val,filter_num_bit
ram.split:080...6061 str val,[r4,#offset CAN:CAN.CAN_FFA1R &0xff]
LAB_08000348: ;XREF[1,0]: 0800033c
ram.split:080...2889 ldrh val,[r5,#0x8]
;set FIFO
ram.split:080...0128 cmp val,#0x1
ram.split:080...02d1 bne LAB_08000354
ram.split:080...6069 ldr val,[r4,#offset CAN:CAN.CAN_FFA1R &0xff]
ram.split:080...3043 orrs val,filter_num_bit
ram.split:080...6061 str val,[r4,#offset CAN:CAN.CAN_FFA1R &0xff]
LAB_08000354: ;XREF[1,0]: 0800034c
ram.split:080...687b ldrb val,[r5,#0xd]
ram.split:080...0128 cmp val,#0x1
ram.split:080...02d1 bne LAB_08000360
ram.split:080...e069 ldr val,[r4,#offset CAN:CAN.CAN_FA1R &0xff]
ram.split:080...3043 orrs val,filter_num_bit
;Enable filter num
ram.split:080...e061 str val,[r4,#offset CAN:CAN.CAN_FA1R &0xff]
LAB_08000360: ;XREF[1,0]: 08000358
ram.split:080...2068 ldr val,[r4,#0x0]=>CAN:CAN.CAN_FMR
ram.split:080...4008 lsrs val,val,#0x1
ram.split:080...4000 lsls val,val,#0x1
ram.split:080...2060 str val,[r4,#0x0]=>CAN:CAN.CAN_FMR
ram.split:080...70bd pop { r4, r5, filter_num_bit, pc }
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
PTR_CAN.CAN_FMR_0800036c: ;XREF[1,0]: 080002be
ram.split:080...00660040 struct_c...CAN:CAN.CAN_FMR
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_IER_SETBIT_08000370(CAN * can_register, undefined4 bit_mask, undefined4 state)
;can_register CAN * r0
;bit_mask undefined4 r1
;state undefined4 r2
;XREF[1,0]: 08000280
ram.split:080...002a cmp state,#0x0
ram.split:080...4269 ldr state,[r0,#can_register->CAN_IER]
ram.split:080...01d0 beq LAB_0800037a
ram.split:080...0a43 orrs state,bit_mask
ram.split:080...00e0 b LAB_0800037c
LAB_0800037a: ;XREF[1,0]: 08000374
ram.split:080...8a43 bics state,bit_mask
LAB_0800037c: ;XREF[1,0]: 08000378
ram.split:080...4261 str state,[r0,#can_register->CAN_IER]
ram.split:080...7047 bx lr
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_CONFIG_08000380(CAN * can_register, struct_can_config * can_config)
;can_register CAN * r0
;can_config struct_can_... r1
;i undefined4 r4 ;XREF[1,0]: 0800042c
;bit_mask undefined4 HASH...
;XREF[1,0]: 0800022e
ram.split:080...10b5 push { r4, lr }
;Bit 1 SLEEP: Sleep mode request: Disable
ram.split:080...0268 ldr r2,[r0,#can_register->CAN_MCR]
ram.split:080...0023 movs r3,#0x0
ram.split:080...0224 movs r4,#0x2
ram.split:080...a243 bics r2,r4
ram.split:080...0260 str r2,[r0,#can_register->CAN_MCR]
;INRQ: Initialization request
;Software sets this bit to request the CAN hardware to enter initialization mode.
ram.split:080...0268 ldr r2,[r0,#can_register->CAN_MCR]
ram.split:080...0124 movs r4,#0x1
ram.split:080...2243 orrs r2,r4
ram.split:080...0260 str r2,[r0,#can_register->CAN_MCR]
ram.split:080...314a ldr r2,[UINT_00ffffff_0800045c] ;= FFFFFFh
ram.split:080...00e0 b LAB_0800039a
LAB_08000398: ;XREF[1,0]: 080003a2
ram.split:080...5b1c adds r3,r3,#0x1
;Wait for INAK: Initialization acknowledge (or too many retries)
LAB_0800039a: ;XREF[1,0]: 08000396
ram.split:080...4468 ldr r4,[r0,#can_register->CAN_MSR]
ram.split:080...e407 lsls r4,r4,#0x1f
ram.split:080...01d1 bne LAB_080003a4
ram.split:080...9342 cmp r3,r2
ram.split:080...f9d1 bne LAB_08000398
LAB_080003a4: ;XREF[1,0]: 0800039e
ram.split:080...4368 ldr r3,[r0,#can_register->CAN_MSR]
ram.split:080...db07 lsls r3,r3,#0x1f
ram.split:080...3ed0 beq LAB_08000428
;Initiaisation mode so configure...
ram.split:080...8c79 ldrb r4,[r1,#can_config->time_triggered_mode]
ram.split:080...8023 movs r3,#0x80
ram.split:080...012c cmp r4,#0x1
ram.split:080...0468 ldr r4,[r0,#can_register->CAN_MCR]
ram.split:080...3bd0 beq LAB_0800042c
ram.split:080...9c43 bics r4,r3
LAB_080003b6: ;XREF[1,0]: 0800042e
ram.split:080...0460 str r4,[r0,#can_register->CAN_MCR]
ram.split:080...cc79 ldrb r4,[r1,#can_config->auto_bus_off]
ram.split:080...4023 movs r3,#0x40
ram.split:080...012c cmp r4,#0x1
ram.split:080...0468 ldr r4,[r0,#can_register->CAN_MCR]
ram.split:080...36d0 beq LAB_08000430
ram.split:080...9c43 bics r4,r3
LAB_080003c4: ;XREF[1,0]: 08000432
ram.split:080...0460 str r4,[r0,#can_register->CAN_MCR]
ram.split:080...0c7a ldrb r4,[r1,#can_config->auto_wakeup]
ram.split:080...2023 movs r3,#0x20
ram.split:080...012c cmp r4,#0x1
ram.split:080...0468 ldr r4,[r0,#can_register->CAN_MCR]
ram.split:080...31d0 beq LAB_08000434
ram.split:080...9c43 bics r4,r3
LAB_080003d2: ;XREF[1,0]: 08000436
ram.split:080...0460 str r4,[r0,#can_register->CAN_MCR]
ram.split:080...4c7a ldrb r4,[r1,#can_config->auto_retransmit]
ram.split:080...1023 movs r3,#0x10
ram.split:080...012c cmp r4,#0x1
ram.split:080...0468 ldr r4,[r0,#can_register->CAN_MCR]
ram.split:080...2cd0 beq LAB_08000438
ram.split:080...9c43 bics r4,r3
LAB_080003e0: ;XREF[1,0]: 0800043a
ram.split:080...0460 str r4,[r0,#can_register->CAN_MCR]
ram.split:080...8c7a ldrb r4,[r1,#can_config->receiver_fifo_loc...
ram.split:080...0823 movs r3,#0x8
ram.split:080...012c cmp r4,#0x1
ram.split:080...0468 ldr r4,[r0,#can_register->CAN_MCR]
ram.split:080...27d0 beq LAB_0800043c
ram.split:080...9c43 bics r4,r3
LAB_080003ee: ;XREF[1,0]: 0800043e
ram.split:080...0460 str r4,[r0,#can_register->CAN_MCR]
ram.split:080...cc7a ldrb r4,[r1,#can_config->tx_fifo_priority]
ram.split:080...0423 movs r3,#0x4
ram.split:080...012c cmp r4,#0x1
ram.split:080...0468 ldr r4,[r0,#can_register->CAN_MCR]
ram.split:080...22d0 beq LAB_08000440
ram.split:080...9c43 bics r4,r3
LAB_080003fc: ;XREF[1,0]: 08000442
ram.split:080...0460 str r4,[r0,#can_register->CAN_MCR]
ram.split:080...8b78 ldrb r3,[r1,#can_config->mode]
ram.split:080...cc78 ldrb r4,[r1,#can_config->sync_jump_width]
ram.split:080...9b07 lsls r3,r3,#30
ram.split:080...2406 lsls r4,r4,#24
ram.split:080...2343 orrs r3,r4
ram.split:080...0c79 ldrb r4,[r1,#can_config->timeseg_1]
ram.split:080...2404 lsls r4,r4,#16
ram.split:080...2343 orrs r3,r4
ram.split:080...4c79 ldrb r4,[r1,#can_config->timeseg_2]
ram.split:080...0988 ldrh can_config,[r1,#can_config->prescaler]
ram.split:080...2405 lsls r4,r4,#20
ram.split:080...2343 orrs r3,r4
ram.split:080...491e subs can_config,can_config,#0x1
ram.split:080...0b43 orrs r3,can_config
ram.split:080...c361 str r3,[r0,#can_register->CAN_BTR]
;Reset CAN_MCR->INRQ and wait till CAN_INAK is 0
ram.split:080...0168 ldr can_config,[r0,#can_register->CAN_MCR]
ram.split:080...4908 lsrs can_config,can_config,#0x1
ram.split:080...4900 lsls can_config,can_config,#0x1
ram.split:080...0160 str can_config,[r0,#can_register->CAN_MCR]
ram.split:080...0021 movs can_config,#0x0
ram.split:080...0ee0 b LAB_08000446
LAB_08000428: ;XREF[2,0]: 080003a8,08000454
ram.split:080...0020 movs can_register,#0x0
ram.split:080...10bd pop { r4, pc }
LAB_0800042c: ;XREF[1,0]: 080003b2
ram.split:080...1c43 orrs i,r3
ram.split:080...c2e7 b LAB_080003b6
LAB_08000430: ;XREF[1,0]: 080003c0
ram.split:080...1c43 orrs i,r3
ram.split:080...c7e7 b LAB_080003c4
LAB_08000434: ;XREF[1,0]: 080003ce
ram.split:080...1c43 orrs i,r3
ram.split:080...cce7 b LAB_080003d2
LAB_08000438: ;XREF[1,0]: 080003dc
ram.split:080...1c43 orrs i,r3
ram.split:080...d1e7 b LAB_080003e0
LAB_0800043c: ;XREF[1,0]: 080003ea
ram.split:080...1c43 orrs i,r3
ram.split:080...d6e7 b LAB_080003ee
LAB_08000440: ;XREF[1,0]: 080003f8
ram.split:080...1c43 orrs i,r3
ram.split:080...dbe7 b LAB_080003fc
LAB_08000444: ;XREF[1,0]: 0800044e
ram.split:080...491c adds can_config,can_config,#0x1
LAB_08000446: ;XREF[1,0]: 08000426
ram.split:080...4368 ldr r3,[r0,#can_register->CAN_MSR]
ram.split:080...db07 lsls r3,r3,#0x1f
ram.split:080...01d0 beq LAB_08000450
ram.split:080...9142 cmp can_config,r2
ram.split:080...f9d1 bne LAB_08000444
LAB_08000450: ;XREF[1,0]: 0800044a
ram.split:080...4068 ldr can_register,[r0,#can_register->CAN_MSR]
ram.split:080...c007 lsls can_register,can_register,#0x1f
ram.split:080...e8d1 bne LAB_08000428
ram.split:080...0120 movs can_register,#0x1
ram.split:080...10bd pop { i, pc }
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
UINT_00ffffff_0800045c: ;XREF[1,0]: 08000394
ram.split:080...ffffff00 uint FFFFFFh
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_RX_08000460(uint * can_base_register, undefined4 fifo, struct_can_buffer * rx_buffer)
;can_base_r... uint * r0
;fifo undefined4 r1
;rx_buffer struct_can_... r2
;rx_ide undefined4 r4 ;XREF[1,0]: 0800046a
;XREF[1,0]: 080004e4
ram.split:080...0b01 lsls r3,fifo,#0x4
ram.split:080...30b5 push { r4, r5, lr }
ram.split:080...1b18 adds r3,r3,can_base_register
ram.split:080...ff33 adds r3,#0xff
ram.split:080...8133 adds r3,#0x81
;CAN receive FIFO mailbox identifier register (CAN_RIxR) (x = 0..1)
;Address offsets: 0x1B0 (0x6c), 0x1C0 (0x70)
;
;CAN1 Base 0x40006400
;CAN2 Base 0x40006800
;Note: Offset * 4 (uint32): 0x6c = 0x1B0
;0x6c => CAN_RI0R
;0x6d => CAN_RDT0R
;0x6e => CAN_RDL0R
;0x6f => CAN_RDH0R
ram.split:080...1c6b ldr rx_ide,[r3,#0x30]
ram.split:080...0425 movs r5,#0x4
;Bit 2 IDE: Identifier extension
;This bit defines the identifier type of message in the mailbox.
;0: Standard identifier.
;1: Extended identifier.
ram.split:080...2c40 ands rx_ide,r5
ram.split:080...1472 strb rx_ide,[r2,#rx_buffer->can_ide]
ram.split:080...1c6b ldr rx_ide,[r3,#0x30]
ram.split:080...29d0 beq LAB_080004ca
ram.split:080...e408 lsrs rx_ide,rx_ide,#0x3
ram.split:080...5460 str rx_ide,[r2,#rx_buffer->can_id_extended]
;Bit 1 RTR: Remote transmission request
;0: Data frame
;1: Remote frame
LAB_0800047a: ;XREF[1,0]: 080004ce
ram.split:080...1c6b ldr rx_ide,[r3,#0x30]
ram.split:080...0225 movs r5,#00000000000000000000000000000010b
ram.split:080...2c40 ands rx_ide,r5
ram.split:080...5472 strb rx_ide,[r2,#rx_buffer->can_rtr]
;DLC
ram.split:080...5c6b ldr rx_ide,[r3,#0x34]
ram.split:080...2407 lsls rx_ide,rx_ide,#0x1c
ram.split:080...240f lsrs rx_ide,rx_ide,#0x1c
ram.split:080...9472 strb rx_ide,[r2,#rx_buffer->can_dlc]
;Bits 15:8 FMI[7:0]: Filter match index
;This register contains the index of the filter the message stored in the mailbox passed
;through.
ram.split:080...5c6b ldr rx_ide,[r3,#0x34]
ram.split:080...240a lsrs rx_ide,rx_ide,#0x8
ram.split:080...d474 strb rx_ide,[r2,#rx_buffer->can_fmi]
;Data
ram.split:080...9c6b ldr rx_ide,[r3,#0x38]
ram.split:080...d472 strb rx_ide,[r2,#rx_buffer->can_data1]
ram.split:080...9c6b ldr rx_ide,[r3,#0x38]
ram.split:080...240a lsrs rx_ide,rx_ide,#0x8
ram.split:080...1473 strb rx_ide,[r2,#rx_buffer->can_data2]
ram.split:080...9c6b ldr rx_ide,[r3,#0x38]
ram.split:080...240c lsrs rx_ide,rx_ide,#0x10
ram.split:080...5473 strb rx_ide,[r2,#rx_buffer->can_data3]
ram.split:080...9c6b ldr rx_ide,[r3,#0x38]
ram.split:080...240e lsrs rx_ide,rx_ide,#0x18
ram.split:080...9473 strb rx_ide,[r2,#rx_buffer->can_data4]
ram.split:080...dc6b ldr rx_ide,[r3,#0x3c]
ram.split:080...d473 strb rx_ide,[r2,#rx_buffer->can_data5]
ram.split:080...dc6b ldr rx_ide,[r3,#0x3c]
ram.split:080...240a lsrs rx_ide,rx_ide,#0x8
ram.split:080...1474 strb rx_ide,[r2,#rx_buffer->can_data6]
ram.split:080...dc6b ldr rx_ide,[r3,#0x3c]
ram.split:080...240c lsrs rx_ide,rx_ide,#0x10
ram.split:080...5474 strb rx_ide,[r2,#rx_buffer->can_data7]
ram.split:080...db6b ldr r3,[r3,#0x3c]
ram.split:080...1b0e lsrs r3,r3,#0x18
ram.split:080...9374 strb r3,[r2,#rx_buffer->can_data8]
ram.split:080...2022 movs rx_buffer,#0x20
ram.split:080...0029 cmp fifo,#0x0
ram.split:080...06d0 beq LAB_080004d0
;CAN_RF1R: CAN receive FIFO 1 register
;Bit 5 RFOM0: Release FIFO 1 output mailbox
;Set by software to release the output mailbox of the FIFO
ram.split:080...0169 ldr fifo,[can_base_register,#0x10]
ram.split:080...1143 orrs fifo,rx_buffer
ram.split:080...0161 str fifo,[can_base_register,#0x10]
ram.split:080...30bd pop { rx_ide, r5, pc }
LAB_080004ca: ;XREF[1,0]: 08000474
ram.split:080...640d lsrs rx_ide,rx_ide,#21
ram.split:080...1460 str rx_ide,[r2,#rx_buffer->can_id_standard]
ram.split:080...d4e7 b LAB_0800047a
;CAN_RF0R: CAN receive FIFO 0 register
;Bit 5 RFOM0: Release FIFO 0 output mailbox
;Set by software to release the output mailbox of the FIFO
LAB_080004d0: ;XREF[1,0]: 080004c0
ram.split:080...c168 ldr fifo,[can_base_register,#0xc]
ram.split:080...1143 orrs fifo,rx_buffer
ram.split:080...c160 str fifo,[can_base_register,#0xc]
ram.split:080...30bd pop { rx_ide, r5, pc }
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_INT_MAIN_080004d8()
;led_pa4_pin undefined4 r0 ;XREF[1,0]: 08000560
;can_id_mod... undefined4 r5 ;XREF[1,0]: 08000586
;rx_buffer undefined1[20] -2c ;XREF[4,21]: 080004ea,08000574,08000582,08000616,080004fe
; 0800058e,080005a4,080005aa,080005b2,080005ba
; 080005c2,080005ca,080005e2,080005e8,080005f0
; 080005f8,08000600,08000608,0800061e,0800062e
; 08000634,0800063c,08000644,0800064c,08000654
;tx_buffer struct_can_... -40 ;XREF[4,36]: 080004f2,0800059a,080005da,08000626,080004f6
; 080004f8,080004fc,08000520,08000544,08000548
; 0800054a,0800054c,0800054e,0800059e,080005a0
; 080005a2,080005a6,080005ae,080005b6,080005be
; 080005c6,080005ce,080005dc,080005de,080005e0
; 080005e4,080005ec,080005f4,080005fc,08000604
; 0800060c,08000628,0800062a,0800062c,08000630
; 08000638,08000640,08000648,08000650,08000658
;sram_ptr undefined4 HASH...
;XREF[1,0]: 08000728
ram.split:080...f0b5 push { r4, r5, r6, r7, lr }
ram.split:080...634f ldr r7,[->Peripherals::CAN] ;= 40006400
ram.split:080...8bb0 sub sp,#0x2c
ram.split:080...05aa add r2,sp,#0x14
ram.split:080...0021 movs r1,#0x0
ram.split:080...3846 mov r0=>CAN:Peripherals::CAN,r7
ram.split:080...fff7bcff bl FUN_CAN_RX_08000460 ;undefined FUN_CAN_RX_08000460(uint *...
ram.split:080...6048 ldr r0,[UINT_000005c1_0800066c] ;= 5C1h
ram.split:080...0599 ldr r1,[sp,#rx_buffer[0]+0x40]
ram.split:080...0024 movs r4,#0x0
;If StdID == 0x5c1:
;
;if
; 0x5c1 x [ 0x1e/0x1d X X X X X X X ] => 0x5c1 8 [ 0x1a X X X X X X X ]
;else
; where (a) is sram[0]
; 0x5c1 x [ 0x22 X X X X X X X ] => 0x5c1 8 [ (a) X X X X X X X ]
;else
; 0x5c1 x [ 0x23 X X X X X X X ] => 0x5c1 8 [ (a+1) X X X X X X X ]
;else
; 0x5c1 x [ 0xa X X X X X X X ] => 0x5c1 8 [ 0xa X X X X X X X ]
; (a) = 0x22
; (a+1) = 0x23
;else
; 0x5c1 x [ 0x28 X X X X X X X ] => 0x5c1 8 [ 0x28 X X X X X X X ]
; (a) = 2, (a+1) = 3
;else
; 0x5c1 x [ X X X X X X X X ] => 0x5c1 8 [ X X X X X X X X ]
ram.split:080...8142 cmp r1,r0
ram.split:080...3fd1 bne LAB_08000572
ram.split:080...0090 str r0=>DAT_000005c1,[sp,#0x0]=>tx_buffer...
ram.split:080...6846 mov r0,sp
ram.split:080...4472 strb r4,[r0,#tx_buffer.can_rtr+0x40]
ram.split:080...0472 strb r4,[r0,#tx_buffer.can_ide+0x40]
ram.split:080...0821 movs r1,#0x8
ram.split:080...8172 strb r1,[r0,#tx_buffer.can_dlc+0x40]
ram.split:080...c07f ldrb r0,[r0,#rx_buffer[11]+0x40]
ram.split:080...1a21 movs r1,#0x1a
ram.split:080...1e28 cmp r0,#0x1e
ram.split:080...0bd0 beq LAB_0800051e
ram.split:080...1d28 cmp r0,#0x1d
ram.split:080...09d0 beq LAB_0800051e
ram.split:080...5949 ldr r1,[PTR_DAT_20000000_08000670] ;= 20000000
ram.split:080...2228 cmp r0,#0x22
ram.split:080...09d0 beq LAB_08000524
ram.split:080...2328 cmp r0,#0x23
ram.split:080...09d0 beq LAB_08000528
ram.split:080...0a28 cmp r0,#0xA
ram.split:080...09d0 beq LAB_0800052c
ram.split:080...2828 cmp r0,#0x28
ram.split:080...0dd0 beq LAB_08000538
ram.split:080...11e0 b LAB_08000542
LAB_0800051e: ;XREF[2,0]: 08000504,08000508
ram.split:080...6846 mov r0,sp
ram.split:080...c172 strb r1,[r0,#tx_buffer.can_data1+0x40]
ram.split:080...10e0 b LAB_08000546
LAB_08000524: ;XREF[1,0]: 0800050e
ram.split:080...0878 ldrb r0,[r1,#0x0]=>sram:UINT_20000000 ;= ??
ram.split:080...0ce0 b LAB_08000542
LAB_08000528: ;XREF[1,0]: 08000512
ram.split:080...0879 ldrb r0,[r1,#offset sram:DAT_20000004 &0xff] ;= ??
ram.split:080...0ae0 b LAB_08000542
LAB_0800052c: ;XREF[1,0]: 08000516
ram.split:080...2220 movs r0,#0x22
ram.split:080...0860 str r0,[r1,#0x0]=>sram:UINT_20000000 ;= ??
ram.split:080...2320 movs r0,#0x23
ram.split:080...4860 str r0,[r1,#offset sram:DAT_20000004 &0xff] ;= ??
ram.split:080...0a20 movs r0,#0xA
ram.split:080...04e0 b LAB_08000542
LAB_08000538: ;XREF[1,0]: 0800051a
ram.split:080...0220 movs r0,#0x2
ram.split:080...0860 str r0,[r1,#0x0]=>sram:UINT_20000000 ;= ??
ram.split:080...0320 movs r0,#0x3
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ram.split:080...2820 movs r0,#0x28
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;Toggle the PA4 LED
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;0x575 => Reset WD Timer
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;0x436 8 [ 1 x x x x 6 x x ] => 0x436 6 [ 1 x x x x x 6 ]
; => 0x439 6 [ 1 x x x x x 6 ]
;
;
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;0x439 8 [ 1 x x x x 6 x x ] => 0x439 6 [ 1 x x x x x 6 ]
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ram.split:080...00 ?? 00h
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ram.split:080...00640040 struct_c...CAN:Peripherals::CAN
UINT_000005c1_0800066c: ;XREF[2,0]: 080004e8,08000572
ram.split:080...c1050000 uint 5C1h
PTR_DAT_20000000_08000670: ;XREF[1,0]: 0800050a
ram.split:080...00000020 uint * sram:UINT_20000000 ;= ??
UINT_00000436_08000674: ;XREF[1,0]: 08000580
ram.split:080...36040000 uint 436h
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_DEFAULTS_08000678(struct_can_config * can_config)
;can_config struct_can_... r0
;XREF[1,0]: 0800020e
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;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_TX_08000698(uint * can_base_register, struct_can_buffer * tx_buffer)
;can_base_r... uint * r0 ;XREF[1,0]: 0800069e
;tx_buffer struct_can_... r1
;can_mailbox undefined4 r0 ;XREF[1,0]: 0800069e
;can_register uint * r2 ;XREF[1,0]: 080006bc
;XREF[4,0]: 08000554,080005d4,08000612,0800065e
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;Look for an empty mailbox
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;Can Id Extended
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LAB_08000712: ;XREF[1,0]: 080006b2
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LAB_08000716: ;XREF[1,0]: 080006ca
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;CAN Id Standard
ram.split:080...1360 str r3,[can_register,#0x0]
ram.split:080...dae7 b LAB_080006dc
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_INT_08000726()
;XREF[0,1]: 000000b8
ram.split:080...10b5 push { r4, lr }
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_INT_START_08000728()
ram.split:080...fff7d6fe bl FUN_CAN_INT_MAIN_080004d8 ;undefined FUN_CAN_INT_MAIN_080004d8()
ram.split:080...10bd pop { r4, pc }
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_EXTI_INT_0800072e()
;XREF[0,1]: 00000054
ram.split:080...10b5 push { r4, lr }
ram.split:080...0120 movs r0,#0x1
ram.split:080...00f00df8 bl FUN_EXTI_READ_08000750 ;undefined FUN_EXTI_READ_08000750(und...
ram.split:080...0028 cmp r0,#0x0
ram.split:080...02d0 beq LAB_08000740
ram.split:080...0120 movs r0,#0x1
ram.split:080...00f002f8 bl FUN_EXTI_WRITE_08000744 ;undefined FUN_EXTI_WRITE_08000744(un...
LAB_08000740: ;XREF[1,0]: 08000738
ram.split:080...10bd pop { r4, pc }
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_EXTI_WRITE_08000744(undefined4 data)
;data undefined4 r0
;XREF[1,0]: 0800073c
ram.split:080...0149 ldr r1,[->Peripherals::EXTI] ;= 40010400
ram.split:080...4861 str data,[r1,#offset EXTI_SYSCFG_COMP:EXT...
ram.split:080...7047 bx lr
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
PTR_EXTI_0800074c: ;XREF[1,0]: 08000744
ram.split:080...00040140 EXTI * EXTI_SYSCFG_COMP:Peripherals::EXTI
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_EXTI_READ_08000750(undefined4 bit_mask)
;bit_mask undefined4 r0
;XREF[1,0]: 08000732
ram.split:080...034a ldr r2,[->Peripherals::EXTI] ;= 40010400
ram.split:080...0146 mov r1,bit_mask
ram.split:080...5269 ldr r2,[r2,#offset EXTI_SYSCFG_COMP:EXTI....
ram.split:080...0020 movs bit_mask,#0x0
ram.split:080...0a42 tst r2,r1
ram.split:080...00d0 beq LAB_0800075e
ram.split:080...0120 movs bit_mask,#0x1
LAB_0800075e: ;XREF[1,0]: 0800075a
ram.split:080...7047 bx lr
PTR_EXTI_08000760: ;XREF[1,0]: 08000750
ram.split:080...00040140 EXTI * EXTI_SYSCFG_COMP:Peripherals::EXTI
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_GPIO_EXTI_08000764(struct_gpio_exti_data * exti_data)
;exti_data struct_gpio... r0
;value_ptr undefined4 r2 ;XREF[1,0]: 08000780
;exti_trigg... uint * r1 ;XREF[1,0]: 080007a0
;exti_regis... EXTI * HASH...
;XREF[1,0]: 08000bf2
ram.split:080...10b5 push { r4, lr }
ram.split:080...8379 ldrb r3,[r0,#exti_data->enable]
ram.split:080...1849 ldr r1,[->Peripherals::EXTI] ;= 40010400
ram.split:080...0268 ldr r2,[r0,#exti_data->bit_mask]
;Interrupt mask register (EXTI_IMR)
;
;Reset value: 0x0FF4 0000 (STM32F03x devices)
;0x7FF4 0000 (STM32F04x devices)
;
;Bits 31:0 IMx: Interrupt Mask on line x (x = 31 to 0)
;0: Interrupt request from Line x is masked
;1: Interrupt request from Line x is not masked
;
;Example data:
; exti_data.bit_mask = 1;
; exti_data.offset = 0;
; exti_data.trigger_register_offset = 12/0x0c (3 x 4 bytes); => Falling EXTI_FTSR
; exti_data.enable = 1;
ram.split:080...002b cmp r3,#0x0
ram.split:080...26d0 beq LAB_080007be
;Presumably this is the enabling part...
;
;Disable bit_mask
ram.split:080...0b68 ldr r3,[r1,#0x0]=>EXTI_SYSCFG_COMP:Periph...
ram.split:080...9343 bics r3,r2
ram.split:080...0b60 str r3,[r1,#0x0]=>EXTI_SYSCFG_COMP:Periph...
;same as above?
ram.split:080...4a68 ldr r2,[r1,#offset EXTI_SYSCFG_COMP:EXTI....
ram.split:080...0368 ldr r3,[r0,#exti_data->bit_mask]
ram.split:080...9a43 bics r2,r3
ram.split:080...4a60 str r2,[r1,#offset EXTI_SYSCFG_COMP:EXTI....
ram.split:080...0279 ldrb r2,[r0,#exti_data->offset]
ram.split:080...5218 adds value_ptr,value_ptr,r1
ram.split:080...1368 ldr r3,[value_ptr,#0x0]=>EXTI_SYSCFG_COMP...
;Turn the bit_mask on
ram.split:080...0468 ldr r4,[r0,#exti_data->bit_mask]
ram.split:080...2343 orrs r3,r4
ram.split:080...1360 str r3,[value_ptr,#0x0]=>EXTI_SYSCFG_COMP...
ram.split:080...8a68 ldr value_ptr,[r1,#offset EXTI_SYSCFG_COM...
ram.split:080...0368 ldr r3,[r0,#exti_data->bit_mask]
ram.split:080...9a43 bics value_ptr,r3
;Rising trigger selection register (EXTI_RTSR)
;
;Cleared
ram.split:080...8a60 str value_ptr,[r1,#offset EXTI_SYSCFG_COM...
ram.split:080...ca68 ldr value_ptr,[r1,#offset EXTI_SYSCFG_COM...
ram.split:080...0368 ldr r3,[r0,#exti_data->bit_mask]
ram.split:080...9a43 bics value_ptr,r3
;Falling trigger selection register (EXTI_FTSR)
;
;Cleared
ram.split:080...ca60 str value_ptr,[r1,#offset EXTI_SYSCFG_COM...
ram.split:080...4279 ldrb value_ptr,[r0,#exti_data->trigger_reg...
;Checks it is not: Software interrupt event register (EXTI_SWIER)
ram.split:080...102a cmp value_ptr,#0x10
ram.split:080...05d0 beq LAB_080007ac
;Point exti_register to the offset trigger.
;Turn bit_mask on.
ram.split:080...5118 adds exti_trig...,value_ptr,exti_trigger_r...
ram.split:080...0a68 ldr value_ptr,[exti_trigger_register,#0x0...
ram.split:080...0068 ldr exti_data,[r0,#exti_data->bit_mask]
ram.split:080...0243 orrs value_ptr,exti_data
ram.split:080...0a60 str value_ptr,[exti_trigger_register,#0x0...
ram.split:080...10bd pop { r4, pc }
LAB_080007ac: ;XREF[1,0]: 0800079e
ram.split:080...8a68 ldr value_ptr,[exti_trigger_register,#off...
ram.split:080...0368 ldr r3,[r0,#exti_data->bit_mask]
ram.split:080...1a43 orrs value_ptr,r3
ram.split:080...8a60 str value_ptr,[exti_trigger_register,#off...
ram.split:080...ca68 ldr value_ptr,[exti_trigger_register,#off...
ram.split:080...0068 ldr exti_data,[r0,#exti_data->bit_mask]
ram.split:080...0243 orrs value_ptr,exti_data
ram.split:080...ca60 str value_ptr,[exti_trigger_register,#off...
ram.split:080...10bd pop { r4, pc }
LAB_080007be: ;XREF[1,0]: 0800076e
ram.split:080...0079 ldrb exti_data,[r0,#exti_data->offset]
ram.split:080...4018 adds exti_data,exti_data,exti_trigger_regi...
ram.split:080...0168 ldr exti_trigger_reg...,[r0,#exti_data->b...
;Setting masked bits to zero...?
;Presumably enabling them for IRQ?
ram.split:080...9143 bics exti_trigger_register,value_ptr
ram.split:080...0160 str exti_trigger_reg...,[exti_data->bit_m...
ram.split:080...10bd pop { r4, pc }
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
PTR_EXTI_080007cc: ;XREF[1,0]: 08000768
ram.split:080...00040140 EXTI * EXTI_SYSCFG_COMP:Peripherals::EXTI
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_GPIO_CONFIG_080007d0(struct_gpio_registers * gpio_registers, struct_gpio_init_data * gpio_init_data)
;gpio_regis... struct_gpio... r0
;gpio_init_... struct_gpio... r1
;bit_num undefined4 r2 ;XREF[1,0]: 080007d2
;bit_mask_low undefined4 r3 ;XREF[1,0]: 080007da
;bit_mask_high undefined4 r5 ;XREF[1,0]: 08000814
;XREF[5,0]: 080001ae,080001c6,080001de,08000902
; 08000be2
ram.split:080...f0b5 push { r4, r5, r6, r7, lr }
ram.split:080...0022 movs bit_num,#0x0
ram.split:080...0124 movs r4,#0x1
LAB_080007d6: ;XREF[1,0]: 0800083c
ram.split:080...2346 mov r3,r4
ram.split:080...0d68 ldr r5,[r1,#gpio_init_data->gpio_value]
ram.split:080...9340 lsls bit_mask_low,bit_num
ram.split:080...1d40 ands r5,bit_mask_low
ram.split:080...9d42 cmp r5,bit_mask_low
ram.split:080...2ad1 bne LAB_08000838
ram.split:080...0d79 ldrb r5,[r1,#gpio_init_data->gpio_moder]
ram.split:080...012d cmp r5,#0x1
ram.split:080...01d0 beq LAB_080007ec
ram.split:080...022d cmp r5,#0x2
ram.split:080...12d1 bne LAB_08000812
LAB_080007ec: ;XREF[1,0]: 080007e6
ram.split:080...8768 ldr r7,[r0,#gpio_registers->GPIO_OSPEEDR]
ram.split:080...5500 lsls r5,bit_num,#0x1
ram.split:080...0326 movs r6,#0x3
ram.split:080...ae40 lsls r6,r5
ram.split:080...b743 bics r7,r6
ram.split:080...8760 str r7,[r0,#gpio_registers->GPIO_OSPEEDR]
ram.split:080...4e79 ldrb r6,[r1,#gpio_init_data->gpio_opseedr]
ram.split:080...ae40 lsls r6,r5
ram.split:080...8568 ldr r5,[r0,#gpio_registers->GPIO_OSPEEDR]
ram.split:080...2e43 orrs r6,r5
ram.split:080...8660 str r6,[r0,#gpio_registers->GPIO_OSPEEDR]
ram.split:080...8588 ldrh r5,[r0,#gpio_registers->GPIO_OTYPER]
ram.split:080...9d43 bics r5,bit_mask_low
ram.split:080...8580 strh r5,[r0,#gpio_registers->GPIO_OTYPER]
ram.split:080...8588 ldrh r5,[r0,#gpio_registers->GPIO_OTYPER]
ram.split:080...8b79 ldrb bit_mask_low,[r1,#gpio_init_data->gpi...
ram.split:080...9340 lsls bit_mask_low,bit_num
ram.split:080...1d43 orrs r5,bit_mask_low
ram.split:080...8580 strh r5,[r0,#gpio_registers->GPIO_OTYPER]
LAB_08000812: ;XREF[1,0]: 080007ea
ram.split:080...0668 ldr r6,[r0,#gpio_registers->GPIO_MODER]
ram.split:080...5500 lsls bit_mask_high,bit_num,#0x1
ram.split:080...0323 movs bit_mask_low,#0x3
ram.split:080...ab40 lsls bit_mask_low,bit_mask_high
ram.split:080...9e43 bics r6,bit_mask_low
ram.split:080...0660 str r6,[r0,#gpio_registers->GPIO_MODER]
ram.split:080...0e79 ldrb r6,[r1,#gpio_init_data->gpio_moder]
ram.split:080...0768 ldr r7,[r0,#gpio_registers->GPIO_MODER]
ram.split:080...ae40 lsls r6,bit_mask_high
ram.split:080...3e43 orrs r6,r7
ram.split:080...0660 str r6,[r0,#gpio_registers->GPIO_MODER]
ram.split:080...c668 ldr r6,[r0,#gpio_registers->GPIO_PUPDR]
ram.split:080...9e43 bics r6,bit_mask_low
ram.split:080...c660 str r6,[r0,#gpio_registers->GPIO_PUPDR]
ram.split:080...cb79 ldrb bit_mask_low,[r1,#gpio_init_data->gpi...
ram.split:080...ab40 lsls bit_mask_low,bit_mask_high
ram.split:080...c568 ldr bit_mask_high,[r0,#gpio_registers->GP...
ram.split:080...2b43 orrs bit_mask_low,bit_mask_high
ram.split:080...c360 str bit_mask_low,[r0,#gpio_registers->GPI...
LAB_08000838: ;XREF[1,0]: 080007e0
ram.split:080...521c adds bit_num,bit_num,#0x1
ram.split:080...102a cmp bit_num,#16
ram.split:080...cbd3 bcc LAB_080007d6
ram.split:080...f0bd pop { r4, bit_mask_high, r6, r7, pc }
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_GPIO_AFRL_08000840(struct_gpio_registers * gpio_register, undefined4 bit_data, undefined4 alternate_function)
;gpio_register struct_gpio... r0
;bit_data undefined4 r1 ;XREF[1,0]: 08000846
;alternate_... undefined4 r2
;bit_pos undefined4 r3 ;XREF[1,0]: 08000842
;index undefined4 r1 ;XREF[1,0]: 08000846
;GPIO alternate function low register (GPIOx_AFRL)
;
;bit_mask consists of:
;Bits[2:0]: GPIO Pin (0-7)
;Bits[3]: index (Low = 0, High =1)
;
;Interesting way to mask lowest 3 bits and multiply by 4
;XREF[2,0]: 08000180,0800018c
ram.split:080...4b07 lsls r3,bit_data,#29
ram.split:080...db0e lsrs bit_pos,bit_pos,#27
;Note: the alternate GPIO functions table is found in the datasheet, not the manual, how stupid...
ram.split:080...9a40 lsls alternate_function,bit_pos
;index is just the top bit (3) to choose first Pins 0-7 (index 0) or Pins 8-15 (index 1) - which is really just deciding b/w AFRL or AFRH
ram.split:080...c908 lsrs index,index,#0x3
ram.split:080...10b5 push { r4, lr }
ram.split:080...8900 lsls index,index,#0x2
ram.split:080...0818 adds gpio_register,index,gpio_register
ram.split:080...016a ldr index,[r0,#gpio_register->GPIO_AFRL]
ram.split:080...0f24 movs r4,#00000000000000000000000000001111b
ram.split:080...9c40 lsls r4,bit_pos
ram.split:080...a143 bics index,r4
ram.split:080...0162 str index,[r0,#gpio_register->GPIO_AFRL]
ram.split:080...016a ldr index,[r0,#gpio_register->GPIO_AFRL]
ram.split:080...1143 orrs index,alternate_function
ram.split:080...0162 str index,[r0,#gpio_register->GPIO_AFRL]
ram.split:080...10bd pop { r4, pc }
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_GPIO_ODR_08000860(struct_gpio_registers * gpio_base_register, undefined2 bit_mask)
;gpio_base_... struct_gpio... r0
;bit_mask undefined2 r1
;XREF[1,0]: 08000560
ram.split:080...0246 mov r2,gpio_base_register
ram.split:080...928a ldrh r2,[r2,#0x14]
ram.split:080...0020 movs gpio_base_register,#0x0
ram.split:080...0a42 tst r2,bit_mask
ram.split:080...00d0 beq LAB_0800086c
ram.split:080...0120 movs gpio_base_register,#0x1
LAB_0800086c: ;XREF[1,0]: 08000868
ram.split:080...7047 bx lr
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_GPIO_BRR_0800086e(struct_gpio_registers * gpio_register, ushort value)
;gpio_register struct_gpio... r0
;value ushort r1
;GPIO port bit reset register (GPIOx_BRR) (x =A..F)
;XREF[2,0]: 080001e8,08000c9e
ram.split:080...0185 strh value,[r0,#gpio_register->GPIO_BRR]
ram.split:080...7047 bx lr
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_GPIO_BSRR_08000872(struct_gpio_registers * gpio_register, undefined4 value)
;gpio_register struct_gpio... r0
;value undefined4 r1
;GPIO port bit set/reset register (GPIOx_BSRR) (x = A..F)
;
;Base is setting, << 16 to reset
;XREF[1,0]: 08000c92
ram.split:080...8161 str value,[r0,#gpio_register->GPIO_BSRR]
ram.split:080...7047 bx lr
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_GPIO_SETPIN_08000876(struct_gpio_registers * gpio_base_register, undefined4 bit_mask, undefined4 state)
;gpio_base_... struct_gpio... r0
;bit_mask undefined4 r1
;state undefined4 r2
;XREF[1,0]: 0800056e
ram.split:080...002a cmp state,#0x0
ram.split:080...01d0 beq LAB_0800087e
ram.split:080...8161 str bit_mask,[r0,#gpio_base_register->GPI...
ram.split:080...7047 bx lr
LAB_0800087e: ;XREF[1,0]: 08000878
ram.split:080...0185 strh bit_mask,[r0,#gpio_base_register->GPI...
ram.split:080...7047 bx lr
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_INT_LOOP_FOREVER_08000882()
;XREF[1,1]: 08000882,0000000c
ram.split:080...fee7 b FUN_INT_LOOP_FOREVER_08000882
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_IWDG_KR_CCCC_08000884()
;XREF[1,0]: 080008ac
ram.split:080...0249 ldr r1,[->Peripherals::IWDG] ;= 40003000
ram.split:080...0148 ldr r0,[UINT_0000CCCC_0800088c] ;= CCCCh
ram.split:080...0860 str r0,[r1,#0x0]=>IWDG_WWDG_RTC:Periphera...
ram.split:080...7047 bx lr
UINT_0000CCCC_0800088c: ;XREF[1,0]: 08000886
ram.split:080...cccc0000 uint CCCCh
PTR_IWDG_08000890: ;XREF[1,0]: 08000884
ram.split:080...00300040 IWDG * IWDG_WWDG_RTC:Peripherals::IWDG
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_IWDG_INIT_08000894()
;XREF[1,0]: 08000c96
ram.split:080...10b5 push { r4, lr }
ram.split:080...0849 ldr r1=>IWDG_WWDG_RT...,[->Peripherals::I...;= 40003000
ram.split:080...0648 ldr r0,[UINT_00005555_080008b4] ;= 5555h
;0101010101010101 => Setup Key
ram.split:080...0860 str r0,[r1,#0x0]=>IWDG_WWDG_RTC:Periphera...
ram.split:080...0620 movs r0,#0x6
;IWDG Prescaler register
;Bits 2:0 PR[2:0]: Prescaler divider
;6 => 110: divider /256
ram.split:080...00f017f8 bl FUN_IWDG_PR_080008d0 ;undefined FUN_IWDG_PR_080008d0(undef...
ram.split:080...0648 ldr r0,[UINT_00000271_080008bc] ;= 271h
;Reload register (IWDG_RLR)
;Bits11:0 RL[11:0]: Watchdog counter reload value
;0x271 => 625
;
;These values look like a 4sec IWDG timeout (256/40,000*625)...
ram.split:080...00f01af8 bl FUN_IWDG_RLR_080008dc ;undefined FUN_IWDG_RLR_080008dc(unde...
;1010101010101010 => WD Reset Key
ram.split:080...00f00af8 bl FUN_IWDG_KR_AAAA_080008c0 ;undefined FUN_IWDG_KR_AAAA_080008c0()
;1100110011001100 => Start WG
ram.split:080...fff7eaff bl FUN_IWDG_KR_CCCC_08000884 ;undefined FUN_IWDG_KR_CCCC_08000884()
ram.split:080...10bd pop { r4, pc }
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
UINT_00005555_080008b4: ;XREF[1,0]: 08000898
ram.split:080...55550000 uint 5555h
PTR_IWDG_080008b8: ;XREF[1,0]: 08000896
ram.split:080...00300040 IWDG * IWDG_WWDG_RTC:Peripherals::IWDG
UINT_00000271_080008bc: ;XREF[1,0]: 080008a2
ram.split:080...71020000 uint 271h
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_IWDG_KR_AAAA_080008c0()
;XREF[2,0]: 0800057c,080008a8
ram.split:080...0249 ldr r1,[->Peripherals::IWDG] ;= 40003000
ram.split:080...0148 ldr r0,[UINT_0000AAAA_080008c8] ;= AAAAh
ram.split:080...0860 str r0,[r1,#0x0]=>IWDG_WWDG_RTC:Periphera...
ram.split:080...7047 bx lr
UINT_0000AAAA_080008c8: ;XREF[1,0]: 080008c2
ram.split:080...aaaa0000 uint AAAAh
PTR_IWDG_080008cc: ;XREF[1,0]: 080008c0
ram.split:080...00300040 IWDG * IWDG_WWDG_RTC:Peripherals::IWDG
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_IWDG_PR_080008d0(undefined4 value)
;value undefined4 r0
;XREF[1,0]: 0800089e
ram.split:080...0149 ldr r1,[->Peripherals::IWDG] ;= 40003000
ram.split:080...4860 str value,[r1,#offset IWDG_WWDG_RTC:IWDG....
ram.split:080...7047 bx lr
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
PTR_IWDG_080008d8: ;XREF[1,0]: 080008d0
ram.split:080...00300040 IWDG * IWDG_WWDG_RTC:Peripherals::IWDG
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_IWDG_RLR_080008dc(undefined4 value)
;value undefined4 r0
;XREF[1,0]: 080008a4
ram.split:080...0149 ldr r1,[->Peripherals::IWDG] ;= 40003000
ram.split:080...8860 str value,[r1,#offset IWDG_WWDG_RTC:IWDG....
ram.split:080...7047 bx lr
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
PTR_IWDG_080008e4: ;XREF[1,0]: 080008dc
ram.split:080...00300040 IWDG * IWDG_WWDG_RTC:Peripherals::IWDG
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_GPIO_INIT_PA4_LED_CONFIG_080008e8()
;gpio_init_... struct_gpio... -10 ;XREF[1,4]: 080008ec,080008f2,080008f6,080008fa,080008fc
;XREF[1,0]: 08000166
ram.split:080...1cb5 push { r2, r3, r4, lr }
ram.split:080...1020 movs r0,#00000000000000000000000000010000b
;Initialise PA4: Output, High Speed, push-pull, No pull-up, pull-down
ram.split:080...0090 str r0,[sp,#0x0]=>gpio_init_data.gpio_value
ram.split:080...0120 movs r0,#0x1
ram.split:080...6946 mov r1,sp
ram.split:080...0871 strb r0,[r1,#gpio_init_data.gpio_moder+0x10]
ram.split:080...0320 movs r0,#0x3
ram.split:080...4871 strb r0,[r1,#gpio_init_data.gpio_opseedr+0...
ram.split:080...0020 movs r0,#0x0
ram.split:080...8871 strb r0,[r1,#gpio_init_data.gpio_otyper+0x10]
ram.split:080...c871 strb r0,[r1,#gpio_init_data.gpio_pupdr+0x10]
ram.split:080...0920 movs r0,#0x9
ram.split:080...c006 lsls r0=>GPIOC...,r0,#0x1b
ram.split:080...fff765ff bl FUN_GPIO_CONFIG_080007d0 ;undefined FUN_GPIO_CONFIG_080007d0(s...
ram.split:080...1cbd pop { r2, r3, r4, pc }
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_INT_NMI_RETURN_08000908()
;XREF[0,1]: 00000008
ram.split:080...7047 bx lr
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_GPIO_NVIC_0800090c(struct_nvic_data * nvic_data)
;nvic_data struct_nvic... r0 ;XREF[1,0]: 0800094e
;int undefined4 r2 ;XREF[1,0]: 08000912
;nvic_register undefined4 r0 ;XREF[1,0]: 0800094e
;XREF[2,0]: 080001f8,08000c02
ram.split:080...30b5 push { r4, r5, lr }
ram.split:080...8378 ldrb r3,[r0,#nvic_data->write]
ram.split:080...0121 movs r1,#0x1
;nvic_bit_num / 4
;
;nvic_ipro_data 0x3 (bottom 2 bits) * 32
ram.split:080...0278 ldrb int,[r0,#nvic_data->nvic_bit_num]
ram.split:080...002b cmp r3,#0x0
ram.split:080...15d0 beq LAB_08000944
ram.split:080...9408 lsrs r4,int,#0x2
ram.split:080...0e4b ldr r3,[PTR_NVIC.IPR0_08000954] ;= e000e400
ram.split:080...a400 lsls r4,r4,#0x2
;Interrupt priority register (IPR0-IPR7)
;Figure out which IPRO register for the nvic_bit_num (i..e divide by 4)
ram.split:080...e418 adds r4,r4,r3
ram.split:080...2368 ldr r3=>NVIC:NVIC.IPR0,[r4,#0x0]
;int = bottom 2 bits multiplied by 4
ram.split:080...9207 lsls int,int,#30
ram.split:080...d50e lsrs r5,int,#27
ram.split:080...ff22 movs int,#0xff
ram.split:080...aa40 lsls int,r5
ram.split:080...9343 bics r3,int
ram.split:080...4278 ldrb int,[r0,#nvic_data->nvic_ipro_data]
;*16
ram.split:080...9207 lsls int,int,#30
ram.split:080...120e lsrs int,int,#24
ram.split:080...aa40 lsls int,r5
ram.split:080...1a43 orrs int,r3
ram.split:080...2260 str int,[r4,#0x0]=>NVIC:NVIC.IPR0
ram.split:080...0078 ldrb nvic_data,[r0,#nvic_data->nvic_bit_num]
ram.split:080...c006 lsls nvic_data,nvic_data,#0x1b
ram.split:080...c00e lsrs nvic_data,nvic_data,#0x1b
ram.split:080...8140 lsls r1,nvic_data
ram.split:080...0548 ldr nvic_data=>NVIC:...,[->Peripherals::N...;= e000e100
ram.split:080...04e0 b LAB_0800094e
LAB_08000944: ;XREF[1,0]: 08000916
ram.split:080...d006 lsls nvic_data,int,#0x1b
ram.split:080...c00e lsrs nvic_data,nvic_data,#0x1b
ram.split:080...8140 lsls r1,nvic_data
ram.split:080...0348 ldr nvic_data,[->Peripherals::NVIC] ;= e000e100
;Interrupt clear-enable register (ICER)
;
; nvic_config.nvic_bit_num = 30 0x1e 00011110;
; nvic_config.2 = 1;
; nvic_config.write = 1;
;
; nvic_config.nvic_bit_num = 5 0101;
; nvic_config.2 = 0;
; nvic_config.write = 1;
;
;e000e100+(4*0x20) => e000e180 => Interrupt clear-enable register (ICER)
ram.split:080...8030 adds nvic_data=>NVIC:NVIC.ICER,#0x80
LAB_0800094e: ;XREF[1,0]: 08000942
; FWD[3,0]: e000e100,e000e180,register:00000020
ram.split:080...0160 str r1,[nvic_register,#0x0]
ram.split:080...30bd pop { r4, r5, pc }
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
PTR_NVIC.IPR0_08000954: ;XREF[1,0]: 0800091a
ram.split:080...00e400e0 uint * NVIC:NVIC.IPR0
PTR_NVIC_08000958: ;XREF[2,0]: 08000940,0800094a
ram.split:080...00e100e0 NVIC * NVIC:Peripherals::NVIC
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_POWER_SLEEP_MODES_0800095c(undefined4 pwr_mode, undefined4 sleep_mode)
;pwr_mode undefined4 r0
;sleep_mode undefined4 r1 ;XREF[1,0]: 0800097e
;value undefined4 r1 ;XREF[1,0]: 0800097e
;base_register undefined4 HASH...
;XREF[1,0]: 08000c7a
ram.split:080...0c4b ldr r3,[->Peripherals::PWR] ;= 40007000
;Power control register (PWR_CR)
;
;Reset value: 0x0000 0000 (reset by wakeup from Standby mode)
;
;Bit 1 PDDS: Power down deepsleep.
;This bit is set and cleared by software. It works together with the LPDS bit.
;0: Enter Stop mode when the CPU enters Deepsleep. The regulator status depends on the LPDS bit.
;1: Enter Standby mode when the CPU enters Deepsleep.
;
;Bit 0 LPDS: Low-power deepsleep.
;This bit is set and cleared by software. It works together with the PDDS bit.
;0: Voltage regulator on during Stop mode
;1: Voltage regulator in low-power mode during Stop mode
;
;Note: When a peripheral that can work in STOP mode requires a clock, the Power controller automatically switch the voltage regulator from Low-power mode to Normal mode and remains in this mode until the request disappears.
ram.split:080...1a68 ldr r2,[r3,#0x0]=>PWR_CRS:Peripherals::PWR
ram.split:080...9208 lsrs r2,r2,#0x2
ram.split:080...9200 lsls r2,r2,#0x2
ram.split:080...0243 orrs r2,pwr_mode
ram.split:080...1a60 str r2,[r3,#0x0]=>PWR_CRS:Peripherals::PWR
ram.split:080...0a48 ldr pwr_mode,[->PTR_CPUID_e000ed00] ;= e000ed00
ram.split:080...0369 ldr r3,[pwr_mode,#offset system_control_b...;= NaP
ram.split:080...0422 movs r2,#00000000000000000000000000000100b
ram.split:080...1343 orrs r3,r2
;System control register (SCR) (0xe000ed00[4] => 0xE000ED10)
;
;The SCR controls features of entry to and exit from low power state.
;
;Bit 2 SLEEPDEEP
;Controls whether the processor uses sleep or deep sleep as its low power mode:
;0: Sleep
;1: Deep sleep.
;Bit 1 SLEEPONEXIT
;Configures sleep-on-exit when returning from Handler mode to Thread mode. Setting this bit to 1 enables an interrupt-driven application to avoid returning to an empty main application.
;0: Do not sleep when returning to Thread mode.
;1: Enter sleep, or deep sleep, on return to Thread mode from an interrupt service routine.
;
;Here we seem to besetting DeepSleep with a choice of:
;Interrupt(mode 1)
;Event (mode 2) OR
;Sleep on retun from Interrupt
ram.split:080...0361 str r3,[pwr_mode,#offset system_control_b...;= NaP
ram.split:080...0129 cmp sleep_mode,#0x1
ram.split:080...06d0 beq LAB_08000984
ram.split:080...0229 cmp sleep_mode,#0x2
ram.split:080...06d0 beq LAB_08000988
;Set Sleep on exit of Interrupt
ram.split:080...0169 ldr sleep_mode,[pwr_mode,#offset system_c...;= NaP
ram.split:080...0222 movs r2,#0x2
ram.split:080...1143 orrs value,r2
LAB_08000980: ;XREF[1,0]: 0800098e
ram.split:080...0161 str value,[pwr_mode,#offset system_contro...;= NaP
ram.split:080...7047 bx lr
LAB_08000984: ;XREF[1,0]: 08000974
ram.split:080...30bf wfi
ram.split:080...00e0 b LAB_0800098a
LAB_08000988: ;XREF[1,0]: 08000978
ram.split:080...20bf wfe
;Set to normal Sleep mode
LAB_0800098a: ;XREF[1,0]: 08000986
ram.split:080...0169 ldr value,[pwr_mode,#offset system_contro...;= NaP
ram.split:080...9143 bics value,r2
ram.split:080...f7e7 b LAB_08000980
PTR_PWR_08000990: ;XREF[1,0]: 0800095c
ram.split:080...00700040 PWR * PWR_CRS:Peripherals::PWR
PTR_DAT_e000ed00_CPUID_0800...;XREF[1,0]: 08000968
ram.split:080...00ed00e0 uint * system_control_block:PTR_CPUID_e000ed00 ;= NaP
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_INT_PENDSV_RETURN_08000998()
;XREF[0,1]: 00000038
ram.split:080...7047 bx lr
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_RCC_AHBENR_0800099c(undefined4 bit_mask, undefined4 state)
;bit_mask undefined4 r0
;state undefined4 r1
;XREF[3,0]: 08000174,08000a18,08000a20
ram.split:080...044a ldr r2,[->Peripherals::RCC] ;= 40021000
ram.split:080...0029 cmp state,#0x0
ram.split:080...5169 ldr state,[r2,#offset RCC:RCC.AHBENR &0xff]
ram.split:080...01d0 beq LAB_080009a8
ram.split:080...0143 orrs state,bit_mask
ram.split:080...00e0 b LAB_080009aa
LAB_080009a8: ;XREF[1,0]: 080009a2
ram.split:080...8143 bics state,bit_mask
LAB_080009aa: ;XREF[1,0]: 080009a6
ram.split:080...5161 str state,[r2,#offset RCC:RCC.AHBENR &0xff]
ram.split:080...7047 bx lr
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
PTR_RCC_080009b0: ;XREF[1,0]: 0800099c
ram.split:080...00100240 struct_r...RCC:Peripherals::RCC
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_RCC_APB1ENR_080009b4(uint bit_mask, undefined4 state)
;bit_mask uint r0
;state undefined4 r1
;XREF[2,0]: 08000200,08000a10
ram.split:080...044a ldr r2,[->Peripherals::RCC] ;= 40021000
ram.split:080...0029 cmp state,#0x0
ram.split:080...d169 ldr state,[r2,#offset RCC:RCC.APB1ENR &0xff]
ram.split:080...01d0 beq LAB_080009c0
ram.split:080...0143 orrs state,bit_mask
ram.split:080...00e0 b LAB_080009c2
LAB_080009c0: ;XREF[1,0]: 080009ba
ram.split:080...8143 bics state,bit_mask
LAB_080009c2: ;XREF[1,0]: 080009be
ram.split:080...d161 str state,[r2,#offset RCC:RCC.APB1ENR &0xff]
ram.split:080...7047 bx lr
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
PTR_RCC_080009c8: ;XREF[1,0]: 080009b4
ram.split:080...00100240 struct_r...RCC:Peripherals::RCC
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_CAN_RCC_APB1RSTR_SETBIT_080009cc(undefined4 bit_mask, undefined4 state)
;bit_mask undefined4 r0
;state undefined4 r1
;XREF[2,0]: 080002a4,080002ac
ram.split:080...044a ldr r2,[->Peripherals::RCC] ;= 40021000
ram.split:080...0029 cmp state,#0x0
ram.split:080...1169 ldr state,[r2,#offset RCC:RCC.APB1RSTR &0...
ram.split:080...01d0 beq LAB_080009d8
ram.split:080...0143 orrs state,bit_mask
ram.split:080...00e0 b LAB_080009da
LAB_080009d8: ;XREF[1,0]: 080009d2
ram.split:080...8143 bics state,bit_mask
LAB_080009da: ;XREF[1,0]: 080009d6
ram.split:080...1161 str state,[r2,#offset RCC:RCC.APB1RSTR &0...
ram.split:080...7047 bx lr
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
PTR_RCC_080009e0: ;XREF[1,0]: 080009cc
ram.split:080...00100240 RCC * RCC:Peripherals::RCC
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_RCC_APB2ENR_080009e4(uint bit_mask, undefined4 state)
;bit_mask uint r0
;state undefined4 r1
;XREF[1,0]: 08000a28
ram.split:080...044a ldr r2,[->Peripherals::RCC] ;= 40021000
ram.split:080...0029 cmp state,#0x0
ram.split:080...9169 ldr state,[r2,#offset RCC:RCC.APB2ENR &0xff]
ram.split:080...01d0 beq LAB_080009f0
ram.split:080...0143 orrs state,bit_mask
ram.split:080...00e0 b LAB_080009f2
LAB_080009f0: ;XREF[1,0]: 080009ea
ram.split:080...8143 bics state,bit_mask
LAB_080009f2: ;XREF[1,0]: 080009ee
ram.split:080...9161 str state,[r2,#offset RCC:RCC.APB2ENR &0xff]
ram.split:080...7047 bx lr
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
PTR_RCC_080009f8: ;XREF[1,0]: 080009e4
ram.split:080...00100240 struct_r...RCC:Peripherals::RCC
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_RCC_INIT_080009fc()
;XREF[2,0]: 08000c68,08000c7e
ram.split:080...10b5 push { r4, lr }
;Not sure why there is so much duplication in these RCC routines...
ram.split:080...00f01df8 bl FUN_RCC_CLEAR_08000a3c ;undefined FUN_RCC_CLEAR_08000a3c()
ram.split:080...00f0b3f8 bl FUN_RCC_CONFIG_08000b6c ;undefined FUN_RCC_CONFIG_08000b6c()
ram.split:080...2420 movs r0,#0x24
ram.split:080...00f012f9 bl FUN_SYSTICK_SOURCE_08000c30 ;undefined FUN_SYSTICK_SOURCE_08000c30()
ram.split:080...0121 movs r1,#0x1
ram.split:080...0807 lsls r0,r1,#0x1c
;10000000 => 00010000 00000000 00000000 00000000
;
;PWREN: 1: Power interface clock enabled
ram.split:080...fff7d0ff bl FUN_RCC_APB1ENR_080009b4 ;undefined FUN_RCC_APB1ENR_080009b4(u...
ram.split:080...0121 movs r1,#0x1
ram.split:080...4804 lsls r0,r1,#0x11
;20000 => 00000000 00000010 00000000 00000000
;
;IOPAEN: 1: I/O port A clock enabled
ram.split:080...fff7c0ff bl FUN_RCC_AHBENR_0800099c ;undefined FUN_RCC_AHBENR_0800099c(un...
ram.split:080...0121 movs r1,#0x1
ram.split:080...8804 lsls r0,r1,#0x12
;00040000 => 00000000 00000100 00000000 00000000
;
;IOPBEN: 1: I/O port B clock enabled
ram.split:080...fff7bcff bl FUN_RCC_AHBENR_0800099c ;undefined FUN_RCC_AHBENR_0800099c(un...
ram.split:080...0121 movs r1,#0x1
ram.split:080...0846 mov r0,r1
;SYSCFGCOMPEN: 1: SYSCFG & COMP clock enabled
ram.split:080...fff7dcff bl FUN_RCC_APB2ENR_080009e4 ;undefined FUN_RCC_APB2ENR_080009e4(u...
ram.split:080...0248 ldr r0=>EXTI_SYSCFG_...,[->Peripherals::S...;= 40010000
;PA11_PA12_RMP: 1: Remap (pin pair PA11/12 mapped instead of PA9/10)
ram.split:080...0168 ldr r1,[r0,#0x0]=>EXTI_SYSCFG_COMP:Periph...
ram.split:080...1022 movs r2,#00000000000000000000000000010000b
ram.split:080...1143 orrs r1,r2
ram.split:080...0160 str r1,[r0,#0x0]=>EXTI_SYSCFG_COMP:Periph...
ram.split:080...10bd pop { r4, pc }
PTR_SYSCFG_08000a38: ;XREF[1,0]: 08000a2c
ram.split:080...00000140 SYSCFG * EXTI_SYSCFG_COMP:Peripherals::SYSCFG
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_RCC_CLEAR_08000a3c()
;rcc_register undefined4 HASH...
;XREF[1,0]: 080009fe
ram.split:080...1248 ldr r0=>RCC:Peripher...,[->Peripherals::RCC];= 40021000
;HSION: 1: HSI oscillator ON
ram.split:080...0168 ldr r1,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...0122 movs r2,#0x1
ram.split:080...1143 orrs r1,r2
ram.split:080...0160 str r1,[r0,#0x0]=>RCC:Peripherals::RCC
;RCC_CFGR: 08FFB80C => 00001000 11111111 10111000 00001100
;
;Setting:
;PLLNODIV: 0: PLL is divided by 2 for MCO
;MCOPRE[2:0]: 000: MCO is divided by 1
;MCO[3:0]: 1000: Internal RC 48 MHz (HSI48) oscillator clock selected
;PLLMUL[3:0]: 1111: PLL input clock x 16
;PLLXTPRE: This bit is the same bit as bit PREDIV[0] from RCC_CFGR2
;PLLSRC[1:0]: 11: HSI48/PREDIV selected as PLL input clock
;ADCPRE: ADC prescaler Obsolete See ADC_CFGR2
;PPRE[2:0]; 0xx: HCLK not divided
;HPRE[3:0]: 0xxx: SYSCLK not divided
;SW[1:0]: 00: HSI selected as system clock
;
;
ram.split:080...4168 ldr r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...104a ldr r2,[UINT_08FFB80C_08000a8c] ;= 8FFB80Ch
ram.split:080...1140 ands r1,r2
ram.split:080...4160 str r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...0168 ldr r1,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...0f4a ldr r2,[UINT_FEF6FFFF_08000a90] ;= FEF6FFFFh
;FEF6FFFF => 11111110 11110110 11111111 11111111
;
;Settings:
;PLLON: PLL enable: 0: PLL OFF
;CSSON: 0: Clock security system disabled (clock detector OFF).
;HSEBYP: HSE crystal oscillator bypass: 1: bypassed with external clock
;HSEON: HSE clock enable: 0: HSE oscillator OFF
;HSION: HSI clock enable: 1: HSI oscillator ON
;
ram.split:080...1140 ands r1,r2
ram.split:080...0160 str r1,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...0168 ldr r1,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...0122 movs r2,#0x1
ram.split:080...9204 lsls r2,r2,#0x12
;fffbffff => 11111111 11111011 11111111 11111111
;
;PLLON: PLL enable: 1: PLL ON
;HSEBYP: HSE crystal oscillator bypass : 0: not bypassed
;CSSON: 1: Clock security system enabled
;HSEON: 1: HSE oscillator ON
;
ram.split:080...9143 bics r1,r2
ram.split:080...0160 str r1,[r0,#0x0]=>RCC:Peripherals::RCC
;ffc0ffff => 11111111 11000000 11111111 11111111
;
;Clearing:
;PLLMUL: 0000: PLL input clock x 2
;PLLXTPRE: 0 PREDIV[0] from RCC_CFGR2
;PLLSRC: 00: HSI/2 selected as PLL input clock (PREDIV forced to divide by 2 on STM32F04x devices)
ram.split:080...4168 ldr r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...3f22 movs r2,#0x3f
ram.split:080...1204 lsls r2,r2,#0x10
ram.split:080...9143 bics r1,r2
ram.split:080...4160 str r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...c16a ldr r1,[r0,#offset RCC:RCC.CFGR2 &0xff]
ram.split:080...0909 lsrs r1,r1,#0x4
;0xfffffff0 => 11111111 11111111 11111111 11110000
;
;PREDIV division factor: 0000: PREDIV input clock not divided
ram.split:080...0901 lsls r1,r1,#0x4
ram.split:080...c162 str r1,[r0,#offset RCC:RCC.CFGR2 &0xff]
ram.split:080...016b ldr r1,[r0,#offset RCC:RCC.CFGR3 &0xff]
ram.split:080...074a ldr r2,[UINT_FFF0FEAC_08000a94] ;= FFF0FEACh
;FFF0FEAC => 11111111 11110000 11111110 10101100
;
;USART3SW: 00: PCLK selected as USART3 clock source (default)
;USART2SW: 00: PCLK selected as USART2 clock source (default)
;ADCSW: ADC clock source selection Obsolete setting
;USART1SW: 00: PCLK selected as USART1 clock source (default)
;I2C1SW: 0: HSI clock selected as I2C1 clock source (default)
;
ram.split:080...1140 ands r1,r2
ram.split:080...0163 str r1,[r0,#offset RCC:RCC.CFGR3 &0xff]
ram.split:080...416b ldr r1,[r0,#offset RCC:RCC.CR2 &0xff]
ram.split:080...4908 lsrs r1,r1,#0x1
;fffffffe => 11111111 11111111 11111111 11111110
;
;HSI48ON: 1: HSI48 oscillator ON
;HSI14ON: 0: HSI14 oscillator OFF
ram.split:080...4900 lsls r1,r1,#0x1
ram.split:080...4163 str r1,[r0,#offset RCC:RCC.CR2 &0xff]
ram.split:080...0021 movs r1,#0x0
;Clock interrupt register (RCC_CIR)
;
;Disable all clock related interrupts
;
;Should really be 0xff000000 to maintain reserved pin state...
ram.split:080...8160 str r1,[r0,#offset RCC:RCC.CIR &0xff]
ram.split:080...7047 bx lr
PTR_RCC_08000a88: ;XREF[1,0]: 08000a3c
ram.split:080...00100240 struct_r...RCC:Peripherals::RCC
UINT_08FFB80C_08000a8c: ;XREF[1,0]: 08000a48
ram.split:080...0cb8ff08 uint 8FFB80Ch
UINT_FEF6FFFF_08000a90: ;XREF[1,0]: 08000a50
ram.split:080...fffff6fe uint FEF6FFFFh
UINT_FFF0FEAC_08000a94: ;XREF[1,0]: 08000a74
ram.split:080...acfef0ff uint FFF0FEACh
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_INT_SVCALL_RETURN_08000a98()
;XREF[0,1]: 0000002c
ram.split:080...7047 bx lr
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_SYSCFG_08000a9c(undefined4 bit_mask, undefined4 bit_num)
;bit_mask undefined4 r0
;bit_num undefined4 r1
;bit_pos undefined4 r3 ;XREF[1,0]: 08000a9e
;syscfg_reg... undefined4 HASH...
;SYSCFG external interrupt configuration register 1
;(SYSCFG_EXTICR1)
;
;Bits 15:0 EXTIx[3:0]: EXTI x configuration bits (x = 0 to 3)
;These bits are written by software to select the source input for the EXTIx external interrupt.
;x000: PA[x] pin
;x001: PB[x] pin
;x010: PC[x] pin
;x011: PD[x] pin
;x100: PE[x] pin
;x101: PF[x] pin
;
;limit to 4:
;value = (bit_num & 0x00000011) * 4
;
;Called with 0,0
;XREF[1,0]: 08000c0a
ram.split:080...8a07 lsls r2,bit_num,#30
ram.split:080...130f lsrs bit_pos,r2,#28
ram.split:080...10b5 push { r4, lr }
ram.split:080...0f22 movs r2,#0xf
ram.split:080...9a40 lsls r2,bit_pos
ram.split:080...8c08 lsrs r4,bit_num,#0x2
ram.split:080...0549 ldr bit_num,[->Peripherals::SYSCFG] ;= 40010000
ram.split:080...a400 lsls r4,r4,#0x2
ram.split:080...6118 adds bit_num,r4,bit_num
ram.split:080...8c68 ldr r4,[bit_num,#offset EXTI_SYSCFG_COMP:...
ram.split:080...9443 bics r4,r2
ram.split:080...8c60 str r4,[bit_num,#offset EXTI_SYSCFG_COMP:...
ram.split:080...8a68 ldr r2,[bit_num,#offset EXTI_SYSCFG_COMP:...
ram.split:080...9840 lsls bit_mask,bit_pos
ram.split:080...0243 orrs r2,bit_mask
ram.split:080...8a60 str r2,[bit_num,#offset EXTI_SYSCFG_COMP:...
ram.split:080...10bd pop { r4, pc }
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
PTR_SYSCFG_08000ac0: ;XREF[1,0]: 08000aa8
ram.split:080...00000140 SYSCFG * EXTI_SYSCFG_COMP:Peripherals::SYSCFG
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_RCC_CONFIG_PLL_FLASH_08000ac4()
;i undefined4 -c ;XREF[4,0]: 08000aca,08000ae4,08000ae8,08000af0
;local_10 undefined4 -10 ;XREF[5,0]: 08000acc,08000ae2,08000aea,08000b02,08000b5c
;rcc_register undefined4 HASH...
;XREF[1,0]: 08000bba
ram.split:080...1cb5 push { r2, r3, r4, lr }
ram.split:080...0021 movs r1,#0x0
ram.split:080...2548 ldr r0=>RCC:Peripher...,[->Peripherals::RCC];= 40021000
ram.split:080...0191 str r1,[sp,#i+0x10]
ram.split:080...0091 str r1,[sp,#0x0]=>local_10
;00010000 => 00000000 00000001 00000000 00000000
;
;HSEON: 1: HSE oscillator ON
ram.split:080...0268 ldr r2,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...0123 movs r3,#0x1
ram.split:080...1b04 lsls r3,r3,#0x10
ram.split:080...1a43 orrs r2,r3
;Wait for HSERDY
ram.split:080...0260 str r2,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...5c00 lsls r4,r3,#0x1
ram.split:080...0522 movs r2,#0x5
ram.split:080...1203 lsls r2,r2,#0xc
LAB_08000ade: ;XREF[1,0]: 08000af4
ram.split:080...0368 ldr r3,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...2340 ands r3,r4
ram.split:080...0093 str r3,[sp,#0x0]=>local_10
ram.split:080...019b ldr r3,[sp,#i+0x10]
ram.split:080...5b1c adds r3,r3,#0x1
ram.split:080...0193 str r3,[sp,#i+0x10]
ram.split:080...009b ldr r3,[sp,#0x0]=>local_10
ram.split:080...002b cmp r3,#0x0
ram.split:080...02d1 bne LAB_08000af6
ram.split:080...019b ldr r3,[sp,#i+0x10]
ram.split:080...9342 cmp r3,r2
ram.split:080...f3d1 bne LAB_08000ade
LAB_08000af6: ;XREF[1,0]: 08000aee
ram.split:080...0268 ldr r2,[r0,#0x0]=>RCC:Peripherals::RCC
;HSERDY to top bit, then check for <0 ???
;
;I think this is just checking for HSERDY bit set...
ram.split:080...9203 lsls r2,r2,#14
ram.split:080...2fd5 bpl LAB_08000b5c
ram.split:080...0121 movs r1,#0x1
ram.split:080...194b ldr r3,[->Peripherals::Flash] ;= 40022000
ram.split:080...1122 movs r2,#00000000000000000000000000010001b
ram.split:080...0091 str r1,[sp,#0x0]=>local_10
;FLASH_ACR:
;PRFTBE: 1: Prefetch is enabled
;LATENCY: 001: One wait state, if 24 MHz < SYSCLK ≤ 48 MHz
ram.split:080...1a60 str r2,[r3,#0x0]=>Flash:Peripherals::Flash
;No sure what the net 2 are doing - nothing...???
;
ram.split:080...4268 ldr r2,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...4260 str r2,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...4268 ldr r2,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...4260 str r2,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...4268 ldr r2,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...7f23 movs r3,#0x7f
ram.split:080...db03 lsls r3,r3,#0xf
;ffc07fff => 11111111 11000000 01111111 11111111
;
;PLLMUL 0000: PLL input clock x 2
;PLLXTPRE 0
;PLLSRC0: HSI/2 selected as PLL input clock (PREDIV forced to divide by 2 on STM32F04x)
ram.split:080...9a43 bics r2,r3
ram.split:080...4260 str r2,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...4268 ldr r2,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...1d23 movs r3,#0x1d
ram.split:080...1b04 lsls r3,r3,#0x10
;Was: ffc07fff => 11111111 11000000 01111111 11111111 OR
;Now: 001d0000 => 00000000 00011101 00000000 00000000
;
;PLLMUL: 0111: PLL input clock x 9
;PLLSRC: 10: HSE/PREDIV selected as PLL input clock
ram.split:080...1a43 orrs r2,r3
ram.split:080...4260 str r2,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...c26a ldr r2,[r0,#offset RCC:RCC.CFGR2 &0xff]
ram.split:080...1209 lsrs r2,r2,#0x4
;Was: fffffff0 => 11111111 11111111 11111111 11110000
;Now: fffffff0 => 11111111 11111111 11111111 11110000
;
;No change
;
;PREDIV division factor: 0000: PREDIV input clock not divided
ram.split:080...1201 lsls r2,r2,#0x4
ram.split:080...c262 str r2,[r0,#offset RCC:RCC.CFGR2 &0xff]
ram.split:080...c26a ldr r2,[r0,#offset RCC:RCC.CFGR2 &0xff]
;PREDIV: 0001: PREDIV input clock divided by 2
ram.split:080...0a43 orrs r2,r1
ram.split:080...c262 str r2,[r0,#offset RCC:RCC.CFGR2 &0xff]
ram.split:080...0168 ldr r1,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...0122 movs r2,#0x1
ram.split:080...1206 lsls r2,r2,#0x18
;010000000 => 00000001 00000000 00000000 00000000 OR
;
;PLLON: 1: PLL ON
ram.split:080...1143 orrs r1,r2
ram.split:080...0160 str r1,[r0,#0x0]=>RCC:Peripherals::RCC
;Wait for PLLRDY
LAB_08000b3a: ;XREF[1,0]: 08000b3e
ram.split:080...0168 ldr r1,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...8901 lsls r1,r1,#0x6
ram.split:080...fcd5 bpl LAB_08000b3a
ram.split:080...4168 ldr r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...8908 lsrs r1,r1,#0x2
;fffffffc => 11111111 11111111 11111111 11111100
;
;SW: 00: HSI selected as system clock
ram.split:080...8900 lsls r1,r1,#0x2
ram.split:080...4160 str r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...4168 ldr r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...0222 movs r2,#0x2
;SW: 10: PLL selected as system clock
ram.split:080...1143 orrs r1,r2
ram.split:080...4160 str r1,[r0,#offset RCC:RCC.CFGR &0xff]
;Wait for SWS: 10: PLL used as system clock
LAB_08000b50: ;XREF[1,0]: 08000b58
ram.split:080...4168 ldr r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...0907 lsls r1,r1,#28
ram.split:080...890f lsrs r1,r1,#30
ram.split:080...0229 cmp r1,#0x2
ram.split:080...fad1 bne LAB_08000b50
ram.split:080...1cbd pop { r2, r3, r4, pc }
LAB_08000b5c: ;XREF[1,0]: 08000afa
ram.split:080...0091 str r1,[sp,#0x0]=>local_10
ram.split:080...1cbd pop { r2, r3, r4, pc }
PTR_RCC_08000b60: ;XREF[1,0]: 08000ac8
ram.split:080...00100240 struct_r...RCC:Peripherals::RCC
PTR_Flash_08000b64: ;XREF[1,0]: 08000afe
ram.split:080...00200240 Flash * Flash:Peripherals::Flash
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_INT_SYSTICK_RETURN_08000b68()
;XREF[0,1]: 0000003c
ram.split:080...7047 bx lr
ram.split:080...00 ?? 00h
ram.split:080...00 ?? 00h
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_RCC_CONFIG_08000b6c()
;rcc_register undefined4 HASH...
;XREF[2,1]: 080000f4,08000a02,08000124
ram.split:080...10b5 push { r4, lr }
ram.split:080...1448 ldr r0=>RCC:Peripher...,[->Peripherals::RCC];= 40021000
;Bit 0 HSION: HSI clock enable
ram.split:080...0168 ldr r1,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...0122 movs r2,#0x1
ram.split:080...1143 orrs r1,r2
ram.split:080...0160 str r1,[r0,#0x0]=>RCC:Peripherals::RCC
;Was: 08FFB80C => 00001000 11111111 10111000 00001100
;Now: F8FFB80C => 11111000 11111111 10111000 00001100
;
;PLLNODIV: 1: PLL is not divided for MCO
;MCOPRE: 111: MCO is divided by 128
ram.split:080...4168 ldr r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...124a ldr r2,[UINT_F8FFB80C_08000bc4] ;= F8FFB80Ch
ram.split:080...1140 ands r1,r2
ram.split:080...4160 str r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...0168 ldr r1,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...114a ldr r2,[UNIT_FEF6FFFF_08000bc8] ;= FEF6FFFFh
;Was: fffbffff => 11111111 11111011 11111111 11111111
;Now: FEF6FFFF => 11111110 11110110 11111111 11111111
;
;Changes:
;PLLON: 0: PLL OFF
;CSSON: 0: Clock security system disabled (clock detector OFF).
;HSEON: 0: HSE oscillator OFF
;
ram.split:080...1140 ands r1,r2
ram.split:080...0160 str r1,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...0168 ldr r1,[r0,#0x0]=>RCC:Peripherals::RCC
ram.split:080...0122 movs r2,#0x1
ram.split:080...9204 lsls r2,r2,#0x12
;Was: FEF6FFFF => 11111110 11110110 11111111 11111111
;Now: fffbffff => 11111111 11111011 11111111 11111111
;
;PLLON: 1: PLL ON
;CSSON: 1: Clock security system enabled (clock detector ON if the HSE is ready, OFF if not).
;HSEBYP: 0: HSE crystal oscillator not bypassed
;HSEON: 1: HSE oscillator ON
ram.split:080...9143 bics r1,r2
ram.split:080...0160 str r1,[r0,#0x0]=>RCC:Peripherals::RCC
;Was: F8FFB80C => 11111000 11111111 10111000 00001100
;Now: FFC0FFFF => 11111111 11000000 11111111 11111111
;
;
;MCO: 0111: PLL clock selected (divided by 1 or 2, depending on PLLNODIV)
; 1000: Internal RC 48 MHz (HSI48) oscillator clock selected
; (not sure which of these)
;
;PLLMUL: 0000: PLL input clock x 2
;PLLXTPRE: 0 This bit is the same bit as bit PREDIV[0] from RCC_CFGR2
;PLLSRC: 00: HSI/2 selected as PLL input clock
;HPRE: 1000: SYSCLK divided by 2
;SW: 00: HSI selected as system clock
;
;
ram.split:080...4168 ldr r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...3f22 movs r2,#0x3f
ram.split:080...1204 lsls r2,r2,#0x10
ram.split:080...9143 bics r1,r2
ram.split:080...4160 str r1,[r0,#offset RCC:RCC.CFGR &0xff]
ram.split:080...c16a ldr r1,[r0,#offset RCC:RCC.CFGR2 &0xff]
ram.split:080...0909 lsrs r1,r1,#0x4
;Was: fffffff0 => 11111111 11111111 11111111 11110000
;Now: fffffff0 => 11111111 11111111 11111111 11110000
;
;No change
ram.split:080...0901 lsls r1,r1,#0x4
ram.split:080...c162 str r1,[r0,#offset RCC:RCC.CFGR2 &0xff]
ram.split:080...016b ldr r1,[r0,#offset RCC:RCC.CFGR3 &0xff]
ram.split:080...ff22 movs r2,#0xff
ram.split:080...5432 adds r2,#0x54
;Was: FFF0FEAC => 11111111 11110000 11111110 10101100
;Now: fffffeac => 11111111 11111111 11111110 10101100
;
;USART3SW: 11: HSI clock selected as USART3 clock
;USART2SW: 11: HSI clock selected as USART2 clock
ram.split:080...9143 bics r1,r2
ram.split:080...0163 str r1,[r0,#offset RCC:RCC.CFGR3 &0xff]
ram.split:080...416b ldr r1,[r0,#offset RCC:RCC.CR2 &0xff]
ram.split:080...4908 lsrs r1,r1,#0x1
;Was: fffffffe => 11111111 11111111 11111111 11111110
;Now: fffffffe => 11111111 11111111 11111111 11111110
;
;No Change
ram.split:080...4900 lsls r1,r1,#0x1
ram.split:080...4163 str r1,[r0,#offset RCC:RCC.CR2 &0xff]
ram.split:080...0021 movs r1,#0x0
;No Change
ram.split:080...8160 str r1,[r0,#offset RCC:RCC.CIR &0xff]
ram.split:080...fff783ff bl FUN_RCC_CONFIG_PLL_FLASH_08000ac4 ;undefined FUN_RCC_CONFIG_PLL_FLASH_0...
ram.split:080...10bd pop { r4, pc }
PTR_RCC_08000bc0: ;XREF[1,0]: 08000b6e
ram.split:080...00100240 struct_r...RCC:Peripherals::RCC
UINT_F8FFB80C_08000bc4: ;XREF[1,0]: 08000b7a
ram.split:080...0cb8fff8 uint F8FFB80Ch
UNIT_FEF6FFFF_08000bc8: ;XREF[1,0]: 08000b82
ram.split:080...fffff6fe uint FEF6FFFFh
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_GPIO_INIT_08000bcc()
;nvic_config undefined3 -10 ;XREF[1,2]: 08000bfa,08000bfc,08000bfe
;gpio_config undefined8 -18 ;XREF[1,2]: 08000bd6,08000bd8,08000bda
;exti_config undefined7 -20 ;XREF[1,3]: 08000be8,08000bea,08000bee,08000bf0
;XREF[1,0]: 08000c6c
ram.split:080...30b5 push { r4, r5, lr }
ram.split:080...85b0 sub sp,#0x14
ram.split:080...0124 movs r4,#0x1
ram.split:080...0025 movs r5,#0x0
ram.split:080...6846 mov r0,sp
;PA0 Input
;
;Presumably not used ???
;
;Odd since the PCB does not seem to have any connections to PA0 ???
ram.split:080...0294 str r4,[sp,#gpio_config+0x20]
ram.split:080...0573 strb r5,[r0,#gpio_config+0x24]
ram.split:080...c573 strb r5,[r0,#gpio_config+0x27]
ram.split:080...0920 movs r0,#0x9
ram.split:080...02a9 add r1,sp,#0x8
ram.split:080...c006 lsls r0=>GPIOC...,r0,#0x1b
ram.split:080...fff7f5fd bl FUN_GPIO_CONFIG_080007d0 ;undefined FUN_GPIO_CONFIG_080007d0(s...
ram.split:080...6846 mov r0,sp
ram.split:080...0094 str r4,[sp,#0x0]=>exti_config
ram.split:080...0571 strb r5,[r0,#exti_config+0x24]
ram.split:080...0c21 movs r1,#12
ram.split:080...4171 strb r1,[r0,#exti_config+0x25]
ram.split:080...8471 strb r4,[r0,#exti_config+0x26]
ram.split:080...fff7b7fd bl FUN_GPIO_EXTI_08000764 ;undefined FUN_GPIO_EXTI_08000764(str...
ram.split:080...0521 movs r1,#0x5
ram.split:080...6846 mov r0,sp
ram.split:080...0174 strb r1,[r0,#nvic_config+0x20]
ram.split:080...4574 strb r5,[r0,#nvic_config+0x21]
ram.split:080...8474 strb r4,[r0,#nvic_config+0x22]
ram.split:080...04a8 add r0,sp,#0x10
ram.split:080...fff783fe bl FUN_GPIO_NVIC_0800090c ;undefined FUN_GPIO_NVIC_0800090c(str...
ram.split:080...0021 movs r1,#0x0
ram.split:080...0846 mov r0,r1
ram.split:080...fff747ff bl FUN_SYSCFG_08000a9c ;undefined FUN_SYSCFG_08000a9c(undefi...
ram.split:080...05b0 add sp,#0x14
ram.split:080...30bd pop { r4, r5, pc }
SUB_08000c12: ;XREF[2,0]: 08000150,08000cb0
ram.split:080...02e0 b FUN_THUNK_08000c1a
LAB_08000c14: ;XREF[1,0]: 08000c1c
ram.split:080...08c8 ldmia r0!,{ r3 }
ram.split:080...121f subs r2,r2,#0x4
ram.split:080...08c1 stmia r1!,{ r3 }
FUN_THUNK_08000c1a: ;XREF[1,0]: 08000c12
ram.split:080...002a cmp r2,#0x0
ram.split:080...fad1 bne LAB_08000c14
ram.split:080...7047 bx lr
ram.split:080...70 ?? 70h p
ram.split:080...47 ?? 47h G
LAB_08000c22: ;XREF[1,0]: 08000cc0
ram.split:080...0020 movs r0,#0x0
ram.split:080...01e0 b LAB_08000c2a
LAB_08000c26: ;XREF[1,0]: 08000c2c
ram.split:080...01c1 stmia r1!,{ r0 }
ram.split:080...121f subs r2,r2,#0x4
LAB_08000c2a: ;XREF[1,0]: 08000c24
ram.split:080...002a cmp r2,#0x0
ram.split:080...fbd1 bne LAB_08000c26
ram.split:080...7047 bx lr
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_SYSTICK_SOURCE_08000c30()
;XREF[1,0]: 08000a08
ram.split:080...0248 ldr r0,[PTR_DAT_e000e000_08000c3c] ;= e000e000
;Bit 2 CLKSOURCE: Clock source selection
;Selects the timer clock source.
;0: External reference clock
;1: Processor clock
ram.split:080...0169 ldr r1,[r0,#offset core_registers:PTR_STK...;= NaP
ram.split:080...0422 movs r2,#0x4
ram.split:080...9143 bics r1,r2
;SysTick control and status register (STK_CSR)
ram.split:080...0161 str r1,[r0,#offset core_registers:PTR_STK...;= NaP
ram.split:080...7047 bx lr
PTR_DAT_e000e000_08000c3c: ;XREF[1,0]: 08000c30
ram.split:080...00e000e0 uint * core_registers:PTR_e000e000 ;= NaP
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;undefined FUN_SYSTICK_CONFIG_08000c40(undefined4 bit_mask)
;bit_mask undefined4 r0
;base_register undefined4 HASH...
;System Control Space 0xe000e000
;
;E000 [0] Base SCR
;E004 [1] Interrupt Control Type Register
;E008 [2] Auxiliary Control Register ACTLR
;E00C [3]
;E010 [4] SysTick Control and Status Register STCSR STK_CSR
;E014 [5] SysTick Reload Value Register STRVR STK_RVR
;E018 [6] SysTick Current Value Register STCVR STK_CVR
;E01c [7] SysTick Calibration Value Register STCR STK_CALIB
;
;XREF[1,0]: 08000c72
ram.split:080...0749 ldr r1,[DAT_00001194_08000c60] ;= 00001194h
ram.split:080...4843 muls bit_mask,r1
ram.split:080...0749 ldr r1,[PTR_DAT_e000e000_08000c64] ;= e000e000
;SysTick reload value register (STK_RVR)
;
;The STK_RVR specifies the start value to load into the STK_CVR.
;
;Called with 0x32 => 50 => 0b00110010
;
;So 0x32 * 0x1194 => 0x36ee8 => 225000
ram.split:080...4861 str bit_mask,[r1,#offset core_registers:P...;= NaP
ram.split:080...0020 movs bit_mask,#0x0
;SysTick current value register (STK_CVR)
;
;The STK_CVR contains the current value of the SysTick counter.
ram.split:080...8861 str bit_mask,[r1,#offset core_registers:P...;= NaP
ram.split:080...0122 movs r2,#0x1
;SysTick control and status register (STK_CSR)
;
;The SysTick CSR register enables the SysTick features.
ram.split:080...0a61 str r2,[r1,#offset core_registers:PTR_STK...;= NaP
;SysTick control and status register (STK_CSR)
;
;Bit 0 ENABLE: Counter enable
;Enables the counter. When ENABLE is set to 1, the counter starts counting down. On reaching
;0, it sets the COUNTFLAG to 1 and optionally asserts the SysTick depending on the value of
;TICKINT. It then loads the RELOAD value again, and begins counting.
;0: Counter disabled
;1: Counter enabled
LAB_08000c50: ;XREF[1,0]: 08000c58
ram.split:080...0a69 ldr r2,[r1,#offset core_registers:PTR_STK...;= NaP
ram.split:080...d307 lsls r3,r2,#0x1f
ram.split:080...01d0 beq LAB_08000c5a
ram.split:080...d203 lsls r2,r2,#15
ram.split:080...fad5 bpl LAB_08000c50
;SysTick control and status register (STK_CSR)
LAB_08000c5a: ;XREF[1,0]: 08000c54
ram.split:080...0861 str bit_mask,[r1,#offset core_registers:P...;= NaP
;SysTick current value register (STK_CVR)
;
;The STK_CVR contains the current value of the SysTick counter.
ram.split:080...8861 str bit_mask,[r1,#offset core_registers:P...;= NaP
ram.split:080...7047 bx lr
DAT_00001194_08000c60: ;XREF[1,0]: 08000c40
ram.split:080...94110000 undefined4 00001194h
PTR_DAT_e000e000_08000c64: ;XREF[1,0]: 08000c44
ram.split:080...00e000e0 uint * core_registers:PTR_e000e000 ;= NaP
;************************************************************************************************
;* FUNCTION *
;************************************************************************************************
;void FUN_MAIN_LOOP_08000c68(void)
;XREF[1,1]: 080000ca,080000cc
ram.split:080...fff7c8fe bl FUN_RCC_INIT_080009fc ;undefined FUN_RCC_INIT_080009fc()
ram.split:080...fff7aeff bl FUN_GPIO_INIT_08000bcc ;undefined FUN_GPIO_INIT_08000bcc()
ram.split:080...3220 movs r0,#00000000000000000000000000110010b
ram.split:080...fff7e5ff bl FUN_SYSTICK_CONFIG_08000c40 ;undefined FUN_SYSTICK_CONFIG_08000c4...
ram.split:080...0121 movs r1,#0x1
ram.split:080...0846 mov r0,r1
;I think this is called with 0x1 & 0x1 as the parameters...?
;
;So Stop Mode & Voltage Regulator is in low power mode AND
;DeepSleep with Wait for Interrupt
ram.split:080...fff76ffe bl FUN_POWER_SLEEP_MODES_0800095c ;undefined FUN_POWER_SLEEP_MODES_0800...
;I think the uC stops here until a CAN interrupt.
;Apprently it needs to re-initialise RCC after waking up...
;
;Might possibly be the IWDG waking it up, not a CAN interrupt...
ram.split:080...fff7bdfe bl FUN_RCC_INIT_080009fc ;undefined FUN_RCC_INIT_080009fc()
ram.split:080...fff76ffa bl FUN_GPIO_INIT_PA4_LED_08000164 ;undefined FUN_GPIO_INIT_PA4_LED_0800...
ram.split:080...fff771fa bl FUN_CAN_GPIO_INIT_0800016c ;undefined FUN_CAN_GPIO_INIT_0800016c()
ram.split:080...0924 movs r4,#0x9
ram.split:080...e406 lsls r4,r4,#0x1b
ram.split:080...1021 movs r1,#00000000000000000000000000010000b
ram.split:080...2046 mov r0=>GPIOC_GPIOB_...,r4
;Set PA4 (LED) High (Off ???)
ram.split:080...fff7eefd bl FUN_GPIO_BSRR_08000872 ;undefined FUN_GPIO_BSRR_08000872(str...
ram.split:080...fff7fdfd bl FUN_IWDG_INIT_08000894 ;undefined FUN_IWDG_INIT_08000894()
ram.split:080...4021 movs r1,#00000000000000000000000001000000b
ram.split:080...2046 mov r0=>GPIOC_GPIOB_...,r4
;Set PA6 Low: TJA1042 STB Mode Normal
ram.split:080...fff7e6fd bl FUN_GPIO_BRR_0800086e ;undefined FUN_GPIO_BRR_0800086e(stru...
;Just let CAN interrupts drive the show.
;Each new CAN packet will reset the IWDG.
;
;So if no new CAN packets in 4sec, IWDG will reset and it will go back into stop mode...
LAB_08000ca2: ;XREF[1,0]: 08000ca2
ram.split:080...fee7 b LAB_08000ca2
UINT_8000CC4_08000ca4: ;XREF[1,0]: 0800014a
ram.split:080...c40c0008 addr UINT_00000002_08000cc4 ;= 2h
PTR_UINT_08000ca8: ;XREF[1,0]: 0800014a
ram.split:080...00000020 addr sram:UINT_20000000 ;= ??
UINT_08000cac: ;XREF[1,0]: 0800014a
ram.split:080...08000000 uint 8h
PTR_SUB_08000cb0: ;XREF[1,0]: 08000148
ram.split:080...120c0008 addr SUB_08000c12
ram.split:080...cc0c0008 addr UINT_08000ccc ;= FFFFFFFFh
ram.split:080...08000020 addr sram:DAT_20000008 ;= ??
ram.split:080...00040000 uint 400h
ram.split:080...220c0008 addr LAB_08000c22
UINT_00000002_08000cc4: ;XREF[2,0]: 0800014a,08000ca4
ram.split:080...02000000 uint 2h
ram.split:080...03000000 uint 3h
UINT_08000ccc: ;XREF[1,0]: 08000cb4
ram.split:080...ffffffff uint FFFFFFFFh
ram.split:080...ffffffff uint FFFFFFFFh
UINT_20000000: ;XREF[6,0]: 0800014a,08000524,0800052e,0800053a
; 08000670,08000ca8
sram:20000000 uint ??
DAT_20000004: ;XREF[3,0]: 08000528,08000532,0800053e
sram:20000004 undefined4 ??
DAT_20000008: ;XREF[1,0]: 08000cb8
sram:20000008 ?? ??
sram:20000009 ?? ??
sram:2000000a ?? ??
sram:2000000b ?? ??
sram:2000000c ?? ??
sram:2000000d ?? ??
sram:2000000e ?? ??
sram:2000000f ?? ??
sram:20000010 ?? ??
sram:20000011 ?? ??
sram:20000012 ?? ??
sram:20000013 ?? ??
sram:20000014 ?? ??
sram:20000015 ?? ??
sram:20000016 ?? ??
sram:20000017 ?? ??
sram:20000018 ?? ??
sram:20000019 ?? ??
sram:2000001a ?? ??
sram:2000001b ?? ??
sram:2000001c ?? ??
sram:2000001d ?? ??
sram:2000001e ?? ??
sram:2000001f ?? ??
sram:20000020 ?? ??
sram:20000021 ?? ??
sram:20000022 ?? ??
sram:20000023 ?? ??
sram:20000024 ?? ??
sram:20000025 ?? ??
sram:20000026 ?? ??
sram:20000027 ?? ??
sram:20000028 ?? ??
sram:20000029 ?? ??
sram:2000002a ?? ??
sram:2000002b ?? ??
sram:2000002c ?? ??
sram:2000002d ?? ??
sram:2000002e ?? ??
sram:2000002f ?? ??
sram:20000030 ?? ??
sram:20000031 ?? ??
sram:20000032 ?? ??
sram:20000033 ?? ??
sram:20000034 ?? ??
sram:20000035 ?? ??
sram:20000036 ?? ??
sram:20000037 ?? ??
sram:20000038 ?? ??
sram:20000039 ?? ??
sram:2000003a ?? ??
sram:2000003b ?? ??
sram:2000003c ?? ??
sram:2000003d ?? ??
sram:2000003e ?? ??
sram:2000003f ?? ??
sram:20000040 ?? ??
sram:20000041 ?? ??
sram:20000042 ?? ??
sram:20000043 ?? ??
sram:20000044 ?? ??
sram:20000045 ?? ??
sram:20000046 ?? ??
sram:20000047 ?? ??
sram:20000048 ?? ??
sram:20000049 ?? ??
sram:2000004a ?? ??
sram:2000004b ?? ??
sram:2000004c ?? ??
sram:2000004d ?? ??
sram:2000004e ?? ??
sram:2000004f ?? ??
sram:20000050 ?? ??
sram:20000051 ?? ??
sram:20000052 ?? ??
sram:20000053 ?? ??
sram:20000054 ?? ??
sram:20000055 ?? ??
sram:20000056 ?? ??
sram:20000057 ?? ??
sram:20000058 ?? ??
sram:20000059 ?? ??
sram:2000005a ?? ??
sram:2000005b ?? ??
sram:2000005c ?? ??
sram:2000005d ?? ??
sram:2000005e ?? ??
sram:2000005f ?? ??
sram:20000060 ?? ??
sram:20000061 ?? ??
sram:20000062 ?? ??
sram:20000063 ?? ??
sram:20000064 ?? ??
sram:20000065 ?? ??
sram:20000066 ?? ??
sram:20000067 ?? ??
sram:20000068 ?? ??
sram:20000069 ?? ??
sram:2000006a ?? ??
sram:2000006b ?? ??
sram:2000006c ?? ??
sram:2000006d ?? ??
sram:2000006e ?? ??
sram:2000006f ?? ??
sram:20000070 ?? ??
sram:20000071 ?? ??
sram:20000072 ?? ??
sram:20000073 ?? ??
sram:20000074 ?? ??
sram:20000075 ?? ??
sram:20000076 ?? ??
sram:20000077 ?? ??
sram:20000078 ?? ??
sram:20000079 ?? ??
sram:2000007a ?? ??
sram:2000007b ?? ??
sram:2000007c ?? ??
sram:2000007d ?? ??
sram:2000007e ?? ??
sram:2000007f ?? ??
sram:20000080 ?? ??
sram:20000081 ?? ??
sram:20000082 ?? ??
sram:20000083 ?? ??
sram:20000084 ?? ??
sram:20000085 ?? ??
sram:20000086 ?? ??
sram:20000087 ?? ??
sram:20000088 ?? ??
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EXTI_SYSCFG_C... EXTI ;Interrupt mask register (E...
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ADC:
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